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原创数电期末作业

2020计本一班数字逻辑基础期末一.教材书P40 图2.45，如图： 1.代码： module adder(a,b,s1,s0); input a,b; output s1,s0; assign s1=a&b; assign s0=a^b; endmodule 2.实验最终（因为没有测试代码，所以我们联合仿真的时候没有波形图，最终如下）视频链接：https://www.bilibili.com/video/BV1Mh411Y7o6?share_source=copy_web 二.Veril

2021-06-28 18:08:11 135

原创数字逻辑基础实验

20计本数字逻辑基础实验一.独热码状态机代码：二.SR锁存器延迟模型代码：module my_rs(reset,set,q,qbar); input reset,set; output q,qbar; nor #(1) n1(q,reset,qbar); nor #(1) n2(qbar,set,q); endmodule module tb_71; reg set,reset; wire q,qbar; initial begin set<=0;reset<=1; #10 set&

2021-06-11 15:06:03 289 1

原创 2021-06-04数字电路基础实验

2020计算机科学与技术数字电路基础实验 ****一.组合逻辑的测试模块代码： module decoder3x8(din,en,dout,ex); input [2:0] din; input en; output [7:0] dout; output ex; reg [7:0] dout; reg ex; always @(din or en) if(en) begin dout=8’b1111_1111; ex=1’b1; end else begin case(din) 3’b000: begin

2021-06-03 23:06:35 187

原创 20计算机科学与技术数字逻辑基础实验

一、modelsim工程仿真流程代码： module fulladd(sum,c_out,a,b,c_in); output sum,c_out; input a,b,c_in; wire s1,c1,c2; xor (s1,a,b); and (c1,a,b); xor (sum,s1,c_in); and (c2,s1,c_in); or (c_out,c2,c1); endmodule 庆幸 13:19:36 module test; wire sum, c_out; reg a,b,c_in;

2021-05-28 20:21:19 187

原创 2021-05-21

数字逻辑基础Verilog 1.代码：module example4(s1,s0,a,b,c,d,e,f,g); input s1,s0; output a,b,c,d,e,f,g; assign a=~s0; assign b=1; assign c=~s0; assign d=~s0; assign e=~s0; assign f=s1&s0; assign g=s1&~s0; endmodule 2.代码：module adder_display(x,y,a,b,c,d,e,f,g);

2021-05-21 22:05:23 82

原创 2020计本数字电路实验三

2020计算机科学与技术数电实验三一.4位加器的门级建模电路结构： 1.打开quartus II，点击新建工程，创一个测试文件的路径。 2.选定工程文件。 3.tool settings选择modelsim。 4.新建文件verilog HDL。 5.将课本中的代码打入到新建的文件中。 6.输入玩完以后进行编译。（如编译失败，则是代码错误，仔细检查） 7.编译成功后进行保存，保存到我们的工程文件中。 8.保存成功后进行运行，点击start compilation。 9.运行后再进行sta

2021-05-07 22:02:27 295

原创 2020计本数电实验二

2020计算机科学与技术数电实验二一: 下载Modelsim SE-64 10.4 1.下载安装包和破解文件patch_dll.bat和MentorKG.exe。 2. 安装好之后，在破解文件复制放在安装目录Win64中。 3. 然后在安装目录中找到Win64中找到mgls.dll / mgls64.dll 两个文件，取消“只读”属性。如图： 4.然后从Win64中找到 patch_dll.bat，点击并运行，等待生成TXT文本，保存在Win64中。 5.恢复mgls.dll / mgls64.dll

2021-04-14 19:58:03 222 2

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