什么是组合逻辑、时序逻辑以及同步时序逻辑？

答：组合逻辑：输出只是当前输入逻辑电平的函数（有延时），与电路的原始状态无关的逻辑电路。（无记忆）由与、或、非门组成的网络，常见的有多路器，数据通路开关，加法器，乘法器等。

    时序逻辑：输出不只是当前输入逻辑电平的函数，还与电路目前所处的状态有关的逻辑电路。（有记忆）由多个触发器和多个组合逻辑块组成的网络，常见的有计数器，运算控制逻辑，指令分析和操作控制逻辑。

    同步时序逻辑：表示状态的寄存器组的值只可能在唯一确定的触发条件发生时改变，只能有时钟的正跳沿或负跳沿出发的状态机就是一例。异步时序逻辑：触发条件有多个控制因素组成，任何一个因素的跳变都可以引起触发。