【ARM Coresight trace 系列文章 10.3 - ARM Coresight STM 寄存器介绍 及STM DMA 传输介绍】

已于 2024-08-11 21:28:11 修改
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分类专栏： # ARM Coresight 系列 # ARM CoreSight Trace 系列 文章标签： arm开发 STM DMA STM drtype datype
于 2023-07-25 16:46:21 首次发布
主公讲ARM
本文链接：https://blog.csdn.net/sinat_32960911/article/details/131906047
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本文介绍了ARM Coresight STM寄存器，特别是与DMA传输相关的部分，包括STM DMA的启动和停止寄存器、控制寄存器。详细阐述了STM如何通过DMA进行数据传输，包括单次和突发传输请求，以及DMA的确认信号。内容涵盖了STM如何通过drtype和datype信号与DMAC交互，以实现高效的内存到STM接口的数据搬运。

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文章目录


上篇文章：ARM Coresight 系列文章 10.2 - ARM Coresight STM Trace packets

STM Register summary

STM 的寄存器主要可以分为以下几类：

  • STM DMA 相关的；
  • STM HW Trigger 相关的；
  • 系统控制及状态寄存器；
  • 只读寄存器。

STM DMA 相关的寄存器

在这里插入图片描述
STM 处理数据的方式有两种：

  • 使用 CPU 往对应的 channels(stimulus port) 中写数据；
  • 使用 DMA 向 对应的channels(stimulus port) 中搬运数据。

其中 STM 对DMA的使用方式又可以分为两种：

  • 调用软件 DMA Driver
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【ARM Coresight 系列文章 2.4 - Coresight 寄存器：DEVARCH，DEVID， DEVTYPE】
CodingCos的博客
08-01 1656
如果这几个寄存器没有使用到，实现时，全部设置为0。如果对应的组件是可以配置的，ARM推荐这几个寄存器可以填写该组件的版本升级信息或者是改动信息。这个寄存器的功能，由实现进行定义，总共包括3个寄存器，DEVID，DEVID1，DEVID2，每个寄存器32位，只读。DEVARCH 寄存器标识了coresight 组件的架构信息。偏移地址分别是：0xFC8, 0xFC4, 0xFC0。对于 ARM 架构来说，这11bits 是固定的。该寄存器中包含了组件的具体类型信息，通过。位域(次设备号)的组合值来表示。
【ARM Coresight trace 系列文章 10 - ARM Coresight STM 介绍及使用】
CodingCos的博客
07-17 1019
ARM 对STM 的解释是其支持高带宽的"仪器化输出"，仪器化输出其实也就是像 Cortex-M 系列中的 ITM 一样，通过将数据写入 STM 的 stimulus port，然后再通过STM将数据送输出，可以送到 System memory， 也可以通过TPIU送出去，之所以说是高带宽是因为 STM的输入口接入了AXI bus，所以CPU 可以通过 AXI bus 将大量数据写入STM。ETM: 如前文所述，ETM主要是用于跟踪 CPU 执行过的一些指令，通常只会统计指令有没有执行。
Coresight（二）coresight寄存器
qq_37573794的博客
12-01 1954
  coresight对于每个coresight组件，规定了一些寄存器，这些寄存器的偏移是固定的，这些寄存器，是必须存在的。但是有的，可以不实现该寄存器功能。 1、寄存器一览   coresight架构，对于coresight的组件，定义了若干个固定的寄存器。第一个寄存器的偏移从0xf00开始，直到0xffc。以下是寄存器列表：   以上的寄存器的地址，在coresight的组件中，是不能当作其他功能使用的。如果该寄存器，在该组件没有实现，那么该寄存器地址要保留，读取要返回0，写被忽略（read must
ARM® CoreSight™ Architecture Specification v3.0 _IHI0029E
11-16
ARM® CoreSight™ Architecture Specification v3.0 _IHI0029E
【ARM Coresight trace 系列文章 10.2 - ARM Coresight STM Trace packets】
CodingCos的博客
07-21 1075
由于接收 STM输出数据的接收器通常是按照bit 流接收的，所以接受器需要知道什么时候开始接收数据，STM 发出的同步包最长可能是由84个连续的0b1组成，也即 21个 0xF, 接着会再发一个0x0(0b0000)，一旦接收器检测到了这个信号，首先会跳过 NULL packet（0x0），然后搜寻 VERSION packet 版本，来确认当前使用的版本号，以便决定后面如何解析剩下的数据。)，payload的位宽为4bits，4bits 也是STP 最小的传输颗粒，专业属于叫做nibble(半字节)。
【ARM Coresight 系列文章 9.1 -- ITM 仪器化跟踪宏单元详细介绍】
CodingCos的博客
10-11 1206
在debug 调试阶段通常都是使用 printf(printk) 来进行进行 log 输出，然后定位问题。那么如果SoC 中没有集成uart 或者 集成uart 不能使用了，那么软降如何将 log 输出出来呢？这个时候就可以通过 ARM coresight 中带的 ITM (仪器化跟踪宏单元) 模块了，它可比UART专业多了——速度快而且能提供多条信道。通过把数据写到 ITM 的寄存器中，调试器能够通过跟踪接口来收集这些数据，并且显示或者处理它。此法不但容易使用，而且比 JTAG 的输出速度更快。
【ARM Coresight | AMBA BUS | Cache 与 MMU/MPU | CoreLink | GCC | CSH 专栏导读】
CodingCos的博客
10-17 6404
1. ARM Coresight（SoC-400/SoC-600） 专栏 2. ARMv8/v9 CPU/Cache 专栏 3. Linux ARM AMBA 总线 专栏 4. Trace32/DS-5 专栏。。。
【嵌入式开发学习必备专栏 Cache | MMU | AMBA BUS | CoreSight | Trace32 | CoreLink | ARM GCC | CSH】
CodingCos的博客
12-30 3818
嵌入式学习必备专栏: ARM Core 的详细介绍， Cache 与 MMU/MPU专栏，Coresight 专栏，劳德巴赫 trace32 专栏， AXI/APB/AHB/ACE/CHI总线专栏、CoreLink 专栏，CSH/BASH/TCL专栏，芯片设计入门专栏、ARM GCC 编译专栏，VIM工具专栏
CoreSight学习笔记
最新发布
kaikai_sk的博客
02-07 3338
channel中也可以产生ctitrigout信号，可以通过配置【CTI Application Pulse register, CTIAPPPULSE】的值，在指定的channel上产生一个channel Event，会将此event传递给相应的trigger。否则向CTI_CONTROL寄存器中写值的话会失效，即，值写不进去，写了在读出来还是没有变化。在channel 3上面产生channel Event，即可给trigger 2发出ctitrigout信号，触发中断。（2）在相应函数中清除中断。
STM32强大的调试和跟踪CoreSight技术
strongerHuang
04-10 3795
关注、星标公众号，不错过精彩内容作者：黄工微信公众号：strongerHuang如今调试STM32能这么方便，在于有一项基于Arm Cortex-M处理器设备的CoreSight技术，...
CoreSight Architecture Specification.pdf
11-30
CoreSight Architecture Specification 详细说明
【ARM Coresight trace 系列文章 10.1 - ARM Coresight STM 介绍及使用】
CodingCos的博客
07-19 1447
有保证的意思，数据不会丢失。STM 支持两种类型的软件的数据，一种是 guaranteed的，另一种是 invariant 的， 对于 guaranteed 类型的数据传输，当STM 无法接收 AXI总线发过来的数据时，会通过拉低。对于 invariant 的数据传输，当STM 无法接收数据时，并不会暂停AXI总线数据的发送，STM 会丢弃AXI发过来的数据，所以无法保证 invariant 数据传输都能够通过STM传输出去。M：Mark, 输出的数据会带有标记，比如一串数据中的某个字当做Mark。
coresight（三）APB，ATB总线
nuoweishizi的博客
08-18 5148
三、APB，ATB总线 APB和ATB总线，是coresight中常用的2个总线。 对于coresight组件的访问，使用debug APB总线进行访问。而对于trace数据的传输，使用ATB总线进行传输。 1. APB总线 以下是信号列表。 clamp value，是指当一个组件是power down或者是disabled，输出的固定值。 APB访问，数据最多是32bit，也就是coresight组件的寄存器的位宽最多是32bit的。 对于PADDRDBG[31]，地址的最高位，表示当前.
Coresight（一）coresight简介
qq_37573794的博客
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STM
ahr7882的博客
09-09 378
STM(System Trace macrocell) STM是coresight system中的一个trace source，可以提供high-bandwidth的trace data。 STM优于Instrumentation Trace Macrocell(ITM)： 1) dedicated AXI slave for receiving instrument...
【ARM Coresight 系列文章 15.1 -- Granular Power Requester 】
CodingCos的博客
04-05 241
也就是控制从 GPR 上 cpwruperq 信号的输出值，寄存器中的每一bit 都控制 cpwrupreq 口上对应的一根信号，该寄存器具体实现多少位，这个是由硬件实现决定的。如果没有 power requestor，通过 DAP，只能对整个 coresight 系统进行上下电操作，但是有了 power requestor，可以对某些关心的组件，进行上下电操作，实现 power 的精细操作。两个寄存器是 requestor 的自定义寄存器，其他有用的均是 coresight 规定的寄存器。
【ARM Coresight 系列文章 2.1 - ARM Coresight 组件分类及功能介绍】
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07-06 1534
本篇文章主要介绍coresight组件相关内容
【ARM Coresight 系列文章 2 - ARM Coresight 介绍】
CodingCos的博客
07-06 2067
ARM Coresight是ARM公司提供的一种调试和跟踪技术，用于ARM处理器的调试和性能分析。它通过在处理器内部集成一组硬件组件，提供了对处理器内部状态和执行信息的可观察性。Coresight技术包括多个组件，如调试接口、调试逻辑和跟踪组件等。调试接口提供了与处理器进行通信的接口，用于调试器与处理器之间的数据交换。调试逻辑是一组硬件逻辑，用于控制和管理调试操作。跟踪组件用于收集处理器的执行信息，包括指令执行、数据访问和事件触发等。ARM Coresight技术可以帮助开发人员进行软件调试和性能分析。
ARM CoreSight STM与LTTng：提升软件调试与跟踪效率
Software: CoreSight STM with LTTng - 19th October 2010" 描述了一篇关于如何通过引入ARM CoreSight System Trace Macrocell (STM) 和 Trace Memory Controller (TMC) 来提升软件开发中的调试和追踪性能的文章。...
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