zynq7000中ddrc的配置

最新推荐文章于 2023-11-13 15:04:23 发布
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分类专栏： FPGA 文章标签： ZedBoard zynq
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版权

目标：为新项目中配置ddrc参数，使ddr能正常工作

工作环境：Win7sp1-64bit

工具：Vivado2015.4

1. 问题简介

       使用zynq7000系列SoC时，若使用DDR需对DDRC进行配置。Xilinx预设了几乎全是镁光的DDR芯片参数，因此若项目使用的就是镁光ddr，memory时序配置无需考虑，配置的只有pcb延时部分。
        Xilinx官方AR#46778(http://china.xilinx.com/support/answers/46778.html)指出了ddr延时由及trace lengths和package length两部分组成，前者对应ddrc中Length，后者对应Package Delay（Vivado）/Package Length（XPS）。
对于package length，Vivado或XPS均提供了依据所选芯片默认提取的参数（其实可以不用修改），但对有强迫症的童鞋（比如
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