FPGA的wire和reg类型变量

最新推荐文章于 2024-05-29 14:50:15 发布
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本文详细介绍了FPGA设计中wire和reg两种类型变量的使用。wire型变量表示结构实体间的物理连接，必须有驱动器，无驱动则为高阻态；reg型变量代表"always"模块内的信号，常作为触发器，初始值不确定，常用于存储数据。在always模块中，所有被赋值的信号应定义为reg型。
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        1：wire型

        网络类型变量表示结构实体（如门）之间的物理连接。网络类型变量不能存储值，而且它必须要受到驱动器（如门或连续赋值语句,如assign）的驱动。如果没有驱动器连接到网络类型变量上，则该变量就是高阻的，即值为Z。常用的网络类型变量有wire和tri型。这两种网络类型变量都是用于连接器件单元。它们有相同的语法格式和功能。之所以提供wire和tri两种网络类型变量，是为了与模型中所使用的变量的实际情况一致。 wire型变量表示单个门驱动或连续赋值语句（如assign)驱动的网络型数据，tri型变量多驱动器驱动的网络类型数据。如果wire和tri型变量没有定义逻辑强度，在多驱动源的情况下，逻辑值会发生冲突，从而产生不确定值。

        wire型数据常用来表示用以assign赋值语句指定的组合逻辑信号。VERILOG程序模块中的输入、输出信号默认

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weixin_33753845
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