iserdese2接口详解_基于FPGA的LVDS过采样技术研究并用Xilinx评估板进行验证 - 全文...

摘要：针对LVDS接口，研究并实现了一种基于FPGA的LVDS过采样技术，重点对LVDS过采样技术中系统组成、ISERDESE2、时钟采样、数据恢复单元、时钟同步状态机等关键技术进行了描述，并基于Xilinx FPGA进行了验证，传输速率达到了1.25Gbps。文章的研究为基于FPGA实现系统之间的高速互连具有一定的工程参考价值。

0 引言

在数字系统互联设计中，高速串行传输方式正逐步替代并行传输方式成为主流。作为串行传输标准的一种，低电压差分信号传输(LVDS)接口具有高速率、低功耗、低噪声和低电磁干扰等优点，广泛应用于高速数字系统设计中。而在实际应用中，采用现场可编程门阵列(FPGA)实现高速LVDS是一种性价比较高的技术途径。

随着半导体工艺的进步，FPGA的性能和集成度在不断提高，在FPGA芯片中均集成SelecTIO资源，通过配置逻辑资源和I/O，可以生成支持LVDS标准的接口，实现高速LVDS接口互联通信。在传统的LVDS互连设计中，均采用同步采样方式，在发送端，一组数据伴随一个时钟同时传输，在接收端，利用一个时钟去采集数据。在Xilinx最新的7系列器件中，支持一种异步过采样方法，当采样的数据时钟相近时(±100ppm)利用SelecTIO资源中的ISEKDES2原语可以实现4X最高频率为1.25Gbps的异步过采样。

本文介绍了一种基于FPGA实现异步LVDS过采样的技术，重点对系统组成、ISERDESE2、时钟采样、数据恢复单元、时钟同步状态机等关键技术进行了描述，并基于Xilinx FPGA进行了验证，传输速率达到了1.25Gbps。

1 异步过采样系统组成

本文采用Xilinx公司的7系列FPGA作为核心器件，基于SelecT