【嵌入式】FPGA入门设计——1位全加器

最新推荐文章于 2023-12-19 21:05:35 发布
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分类专栏： 嵌入式系统应用开发 文章标签： 嵌入式 fpga
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目录

一、实验准备

实验目的：

基于Quartus-II软件完成一个1位全加器的设计，分别采用：原理图输入以及Verilog编程 这两种设计方法。

实验环境：

  • 软件：QuartusII 13.0
  • 开发板：Intel DE2-115

二、设计半加器

详细操作见：【嵌入式】Quartus-II实现D触发器

1、创建工程

开发板选择【EP4CE115F29C7】
在这里插入图片描述

2、创建原理图文件

【File】→【New】
在这里插入图片描述
添加元件

  • and2 ×1
  • xor ×1
  • 输入引脚input ×2
  • 输出引脚output ×2

连接
在这里插入图片描述
保存文件

3、编译原理图文件

编译
在这里插入图片描述

【tool】→【Netlist Viewers】→【RTL Viewer】查看电路图
在这里插入图片描述

4、仿真

【File】→【New】创建VWF文件

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