ZYNQ的启动梗概


一、ZYNQ的启动方式有哪些?

1.ZYNQ启动方式

ZYNQ分为两种启动模式:Master Mode(主模式)和Slave Mode(从模式)。
Master Mode启动模式主要就是通过外部Flash存储设备启动的方式;譬如包括:QSPI、SD卡、NAND、Nor。
Slave Mode启动模式就是通过JTAG方式启动。
所以ZYNQ一共支持5种启动方式:
QSPI启动
SD卡启动
NAND启动
Nor启动
JTAG启动
其中前面四种启动方式被称为Master Mode启动,二最后一种启动方式被称为Slave Mode启动。

2.正点原子启动方式

正点原子领航者/启明星开发板支持哪些启动方式
领韩者开发板或启明星开发板并没有全部支持者5种启动方式,其中我们的领韩者开发板或启明新开发板只支持3种启动方式:QSPI启动、SD卡启动以及JTAG启动。不支持NAND启动和Nor启动。

二、启动原理和配置方式

1.启动配置

正点原子领航者/启明星开发板如何配置启动方式
领韩者开发板或启明星开发板可以通过地板上的拨码开关对启动方式进行配置

2.原理分析

所以从这个原理图分析可知,这个拨码开关就是用与控制右边两个引脚BOOT_MODE0和BOOT_MODE1的电平状态,拉高或者拉低。
所以从这里可以知道,如果要将开发板从SD卡方式启动,则需要将BOOT_MODE0和BOOT_MODE1两个引脚给拉高。

总结

ZYNQ一共有五种启动方式,而正点原子支持其中的三种,启动原理是依靠开关来调节电平实现的,因此可以实现三种以上的启动方式。

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文档共60页。主要向初学者提供了Zynq开发的技术方向,针对不同应用给出了基本的参考文档;同时对Zynq双核AMP加载方式做了详细描述,对Zynq的fsbl启动流程做了简单介绍。章节如下: Zynq User Guide 1 介绍 4 2 快速上手指南 4 3 多核开发教程 4 3.1 AMP开发说明 6 3.1.1 快速生成amp工程 6 3.1.2 Generating Boot File 8 3.1.3 烧写程序 9 3.1.4 启动 10 3.1.5 调试 10 3.1.6 总结 11 3.2 SMP开发说明 11 4 ZC706启动代码分析 11 4.1 启动代码 12 4.2 FSBL流程(FOR AMP) 13 4.3 CPU0启动CPU1流程 14 5 程序在线烧写方案及流程 14 5.1 程序烧写需求 14 5.2 提出该需求的原因 14 5.3 程序烧写方案 14 5.3.1 BOOT.BIN组成 14 5.3.2 BOOT.BIN生成方法 15 5.4 FSBL.BIN和APP.BIN等的生成 15 5.5 制作*BIN及烧写的具体步骤 15 5.5.1 制作*bin流程 15 5.5.2 BOOT.bin制作过程 15 5.5.3 FSBL.bin和APP.bin等的生成过程 22 5.6 烧写BOOT.BIN步骤 26 5.6.1 通过SDK工具烧写步骤 26 5.6.2 通过上位机烧写软件的烧写步骤 29 5.6.3 通过串口调试助手烧写步骤 29 6 Zynq Qspi控制器 30 6.1 基本特性 30 6.2 I/O接口 31 6.3 QSPI控制器模式 33 6.3.1 I/O模式 33 6.3.2 线性地址(linear address)模式 33 6.3.3 传统(legacy)SPI模式 34 6.4 QSPI 例程 34 6.5 QSPI控制器支持访问32MB方法 35 6.5.1 Bank地址寄存器(Bank address register) 35 6.5.2 扩展地址模式(Extended address mode) 35 6.5.3 使用新写命令(New commands) 35 6.6 QSPI FLASH选择 35 6.7 作为BOOT器件考虑 35 7 µC/OS系统启动指南 36 7.1 INTRODUCTION 36 7.1.1 Software Requirements 36 7.1.2 Hardware Requirements 36 7.2 HARDWARE DESIGN 37 7.2.1 Step 1. Invoke the Vivado IDE and Create a project 37 7.2.2 Step 2. Create an IP Integrator Design 39 7.2.3 Step 3. Add and setup the Zynq processor system IP block 39 7.2.4 Step 4. Customize the Zynq block for our design 41 7.2.5 Step 5. Add the soft peripherals 45 7.2.6 Step 6. Generate HDL Design Files 47 7.2.7 Step 7. Synthesis, Implement and Generate Bitstream 48 7.3 SOFTWARE DESIGN 49 7.3.1 Step 1. Installation of the µC/OS Repository 49 7.3.2 Step 2. Generate the µC/OS BSP 50 7.3.3 Step 3. Build and Debug the Demonstration Project 54 7.3.4 Step 4. Program the AXI Timer 0 with the ucos_axitimer Driver 55 7.3.5 Step 5. Program the AXI Timer 1 with the Xilinx tmrctr Driver 58 7.4 CONCLUSION 59 8 Linux系统启动指南 59
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