名称:基于FPGA的多功能数字钟设计Verilog代码ISE仿真(文末获取)
软件:ISE
语言:Verilog
代码功能:
多功能数字钟、闹钟、秒表、定时等设计
1.正常的显示时间的小时、分钟和秒的计时显示;
2.该数字钟应具有校时电路功能(即当时间不准时,可以通过调整时间的分钟和小时来进行校时)。
3.该数字钟应该具有秒表的功能。
4.该数字钟应该具有闹钟的功能(即能任意设置闹钟的时间,也能实现闹钟的关闭功能)。
5.该数字钟应该具有定时(倒计时)的功能
1. 工程文件
2. 程序文件
3. 程序编译
4. RTL图
5. Testbench
6. 仿真图
整体仿真图
分频模块
按键模块
模式设置模块
计时模块
闹钟模块
秒表模块
倒计时模块
响铃模块
显示模块
部分代码展示:
//顶层模块 module Digital_clock( input clk_50M, input key_0,//模式设置按键--4'd0:计时,4'd1:闹钟,4'd2:跑表,4'd3:定时 input key_1,//设置修改,跑表启动 input key_2,//修改确认,跑表暂停 input key_3,//修改时分秒,跑表复位,闹钟关闭 output bell_green,//整点报时 output bell_red,//闹钟led output [3:0] led_mode,//led显示当前模式 output [7:0] HEX0,//数码管-低亮 output [7:0] HEX1,//数码管-低亮 output [7:0] HEX2,//数码管-低亮 output [7:0] HEX3, //数码管-低亮 output [7:0] HEX4,//数码管-低亮 output [7:0] HEX5 //数码管-低亮 ); wire [3:0] state_mode;//当前模式,4'd0:计时,4'd1:闹钟,4'd2:跑表 wire [7:0] hour_time;//时 wire [7:0] minute_time;//分 wire [7:0] second_time;//秒 wire [7:0] alarm_hour_time;//闹钟时 wire [7:0] alarm_minute_time;//闹钟分 wire [7:0] alarm_second_time;//闹钟秒 wire [7:0] stopwatch_Millisecond;//10毫秒 wire [7:0] stopwatch_second;//秒 wire [7:0] stopwatch_minute;//分 wire [7:0] countdown_hour_time;//时 wire [7:0] countdown_minute_time;//分 wire [7:0] countdown_second_time;//秒 wire key_0_negedge; wire key_1_negedge; wire key_2_negedge; wire key_3_negedge; wire clk_1Hz; wire clk_100Hz; fenping fenping_Hz( . clk_50M(clk_50M), . clk_1Hz(clk_1Hz), . clk_100Hz(clk_100Hz) ); key_jitter key_0_jitter( . clkin(clk_50M), . key_in(key_0), . key_posedge(), . key_negedge(key_0_negedge), . key_value() ); key_jitter key_1_jitter( . clkin(clk_50M), . key_in(key_1), . key_posedge(), . key_negedge(key_1_negedge), . key_value() ); key_jitter key_2_jitter( . clkin(clk_50M), . key_in(key_2), . key_posedge(), . key_negedge(key_2_negedge), . key_value() ); key_jitter key_3_jitter( . clkin(clk_50M), . key_in(key_3), . key_posedge(), . key_negedge(key_3_negedge), . key_value() ); set_mode i_set_mode( . clk_50M(clk_50M), . set_mode_key(key_0_negedge), . led_mode(led_mode),//led显示当前模式 . state_mode(state_mode)//当前模式,4'd0:计时,4'd1:闹钟,4'd2:跑表 ); jishi i_jishi( . clk_50M(clk_50M), . clk_1Hz(clk_1Hz), . state_mode(state_mode),//当前模式,4'd0:计时,4'd1:闹钟,4'd2:跑表 . set_time_key(key_1_negedge),//设置时间 . confirm_key(key_2_negedge),//确认 . change_time_key(key_3_negedge),//设置时分秒 . hour_time(hour_time),//时 . minute_time(minute_time),//分 . second_time(second_time)//秒 ); alarm_clock i_alarm_clock( . clk_50M(clk_50M), . state_mode(state_mode),//当前模式,4'd0:计时,4'd1:闹钟,4'd2:跑表 . set_time_key(key_1_negedge),//设置时间 . confirm_key(key_2_negedge),//确认 . change_time_key(key_3_negedge),//设置时分秒 . alarm_hour_time(alarm_hour_time),//时 . alarm_minute_time(alarm_minute_time),//分 . alarm_second_time(alarm_second_time)//秒 ); stopwatch i_stopwatch( . clk_50M(clk_50M), . clk_100Hz(clk_100Hz),//100Hz--对应10ms . state_mode(state_mode),//当前模式,4'd0:计时,4'd1:闹钟,4'd2:跑表 . start_key(key_1_negedge),//启动 . stop_key(key_2_negedge),//暂停 . reset_key(key_3_negedge),//复位 . stopwatch_Millisecond(stopwatch_Millisecond),//10毫秒 . stopwatch_second(stopwatch_second),//秒 . stopwatch_minute(stopwatch_minute)//分 ); timing i_timing( . clk_50M(clk_50M), . clk_1Hz(clk_1Hz), . state_mode(state_mode),//当前模式,4'd0:计时,4'd1:闹钟,4'd2:跑表,4'd3:定时 . set_time_key(key_1_negedge),//设置时间 . confirm_key(key_2_negedge),//确认 . change_time_key(key_3_negedge),//设置时分秒 . countdown_hour_time(countdown_hour_time),//时 . countdown_minute_time(countdown_minute_time),//分 . countdown_second_time(countdown_second_time)//秒 ); Bell i_Bell( . clk_50M(clk_50M),
源代码
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