vivado例化多个iserdes IP核时遇到问题[Shape Builder 18-119]

在Vivado设计中,遇到多个iserdesIP核使用同一外部时钟导致的ibufds重叠错误。解决方法是通过MMCM将外部时钟进行分频,然后将MMCM的输出时钟分别连接到各个iserdesIP核的内部时钟输入,选择‘internalclock’选项。这样可以避免时钟路径冲突并确保设计的正确性。
摘要由CSDN通过智能技术生成

使用vivado例化多个iserdes IP核时遇到以下问题

[Shape Builder 18-119] Failed to create I/OLOGIC Route Through shape for instance u_data_get/inst_iserdes_28/inst/ibufds_clk_inst. Found overlapping instances within the shape: u_data_get/inst_iserdes_0/inst/ibufds_clk_inst and u_data_get/inst_iserdes_28/inst/ibufds_clk_inst.

大体意思是ibufds重叠了,因为IP核我使用的是“external clock”,把外部时钟连接到两个以上的ibufds上,这样是不行的。

解决方法是把外部时钟进一个mmcm,然后输出时钟连到这些个selectio ip核上,ip核选项里选“internal clock”,即可解决。

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