【UVM实战】第一章：配置UVM环境（以VCS为例），跑通书上的例子（包括清理中间文件方法、使用DVE查看波形方法、命令执行原理探究）

已于 2023-03-26 19:42:08 修改
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分类专栏： # UVM实战 文章标签： UVM实战 VCS
于 2022-02-12 12:58:48 首次发布
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本文详细介绍了如何配置UVM环境，以VCS为例，包括下载书本源码、设置共享文件夹、修改setup.vcs脚本、加载环境变量、运行书本示例程序并清理中间文件，同时讲解了使用DVE查看波形的方法和对命令执行原理的探究。
摘要由CSDN通过智能技术生成

文章目录

1、下载书本源码

源码下载地址：http://www.hzcourse.com/web/refbook/detail/5651/229

这里我将其保存在win10下的 F:\1-IC验证\UVM实战 code 目录，并解压出puvm文件夹和uvm-1.1d文件夹，如下图所示：

在这里插入图片描述

2、设置共享文件夹

打开虚拟机，依次点击菜单栏中的：虚拟机→设置→选项→共享文件夹→总是启用，然后在“文件夹中”添加书本源码所在目录，如下图：

在这里插入图片描述

温馨提示：上图中的5所在位置的名称，最好自定义为不带中文的英文字母

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Error-[SE] Syntax error Following verilog source has syntax error : "/home/synopsys/vcs-mx/O-2018.09-1/etc/uvm/uvm_pkg.sv", 31: token is ';' package uvm_pkg; 怎么办
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根据错误信息来看，语法错误出现在文件 "/home/synopsys/vcs-mx/O-2018.09-1/etc/uvm/uvm_pkg.sv" 的第31行，错误是分号 ';'。要解决这个问题，您可以尝试以下几个步骤： 1. 检查分号 ';' 的前后语法，确保在正确的位置使用了分号。可能是缺少了某些代码或者多了一些不应该出现的分号。 2. 确保文件中所有的语法都是符合 Verilog 和 SystemVerilog 的规范。 3. 检查 uvm_pkg.sv 文件是否完整且未被修改过。如果文件损坏或修改错误，可以尝试从原始源文件中获取正确的版本。 4. 如果您使用的是特定版本的 UVM（例如 UVM 1.2），请确保您正在使用正确的 uvm_pkg.sv 文件，该文件与您正在使用的 UVM 版本相匹配。 如果以上步骤无法解决问题，我建议您提供更详细的错误信息或相关代码片段，以便我能够更准确地帮助您解决问题。
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