CMOS门电路

本文介绍了数字电子技术的基础知识,包括逻辑代数运算符号、门电路的构造与工作原理等内容。详细解析了MOS管的结构及其在CMOS反相器、与非门、或非门等电路中的应用,并介绍了OD门、CMOS传输门及三态输出的CMOS门电路的工作机制。
摘要由CSDN通过智能技术生成


数电的基础知识隔时间太久全忘光了,前几天面试被问麻了,回过头来再看一下。

一、逻辑代数运算符号

(数字电子技术基础P21)

与、或、非

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真值表如下:
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与非、或非、与或非

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真值表如下:
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异或、同或

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异或逻辑与同或逻辑的真值表如下:

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二、门电路

(数字电子技术基础第三章)

MOS管的结构

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如图所示是MOS管的结构示意图和符号,在P型半导体衬底上制作两个高掺杂浓度的N型区,形成MOS管的源极S和漏极D。第三个电极称为栅极G,通常用金属铝或多晶硅制作。栅极和衬底之间被二氧化硅绝缘层隔开。

MOS管的四种类型

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CMOS反相器

CMOS反相器的电路结构与电路图如下所示,其中T1是P沟道增强型MOS管,T2是N沟道增强型MOS管。

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特点:

  1. 无论输出高、低电平,均有一管导通。
  2. T1、T2必有一个截止,功耗低。

用 MOS 管搭出二输入与非门、或非门

与非门:上面两个 PMOS 并联,下面两个 NMOS 串联。
或非门:上面两个 PMOS 串联,下面两个 NMOS 并联。
(与非门:上并下串 或非门:上串下并)
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在CMOS电路中可以增加缓冲级,即在门电路的每个输入端、输出端各增设一级反相器。
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OD门

在CMOS电路中,为了满足输出电平变换、吸收大负载电流以及实现线与连接等需要,有时将输出级电路结构改为一个漏级开路输出的MOS管,构成漏级开路输出门电路,简称OD门。
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  • OD门工作时必须将输出端经上拉电阻RL接到电源上。
  • 将几个OD门的输出端直接相连,可以实现线与逻辑。比如下图中的例子,用两个OD输出与非门接成线与逻辑,从而形成一个与或非电路。

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CMOS传输门

利用P沟道MOS管和N沟道MOS管的互补性可以接成如下图所示的CMOS传输门。
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T1是N沟道增强型MOS管,T2是P沟道增强型MOS管。因为T1和T2的源级和栅极在结构上是完全对称的,所以栅极的引出端画在栅极的中间。T1和T2的源极和漏级分别相连作为传输门的输入端和输出端。

三态输出的CMOS门电路

三态输出门电路的输出除了有高、低电平这两个状态以外,还有第三个状态——高阻态。下图是三态输出反相器的电路结构图。因为这种电路结构总是接在集成电路的输出端,所以也将这种电路称为输出缓冲器。
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EN’为三态控制端。EN’=1时,不管A的状态如何,G4输出高电平而G5输出低电平,T1和T2同时截止,输出呈现高阻态。

### CMOS门电路逻辑表达式及工作原理 #### 逻辑表达式的多样性 对于一个具体的逻辑问题,虽然其对应的真值表是唯一的,但是实现这一真值表的逻辑电路可以有多种形式。因此,在设计过程中可以根据实际情况调整逻辑表达式的形式,以便更好地适应现有资源或简化电路结构[^1]。 #### 基本CMOS门的工作机制 CMOS(互补金属氧化物半导体)技术利用N沟道MOSFET和P沟道MOSFET组成各种类型的门电路。这些门电路能够执行基本的布尔运算操作,如AND、OR、NOT等。每种门都有相应的逻辑表达式来表示输入信号到输出信号之间的关系: - **反相器(Not Gate)** 反相器是最简单的CMOS门之一,它只有一个输入端A和一个输出端Y。当输入为高电平时,输出则为低电平;反之亦然。逻辑表达式为 \( Y=\overline{A} \)[^2] - **与门(And Gate)** 当所有输入都处于高状态时,与门才会给出高的输出。对于两个输入的情况,逻辑表达式写作\( Y=A\cdot B\) 。如果是三个输入,则变为 \( Y=A\cdot B\cdot C \),以此类推. - **或门(Or Gate)** 或门只要有一个以上的输入为高就会产生高电平作为输出。两输入情况下的逻辑表达式为 \( Y=A+B \); 若增加至三输入, 则变成 \( Y=A+B+C \) . #### 复杂门电路的例子 除了上述基础单元外,还可以构建更为复杂的门电路,比如异或(XOR), 同或(XNOR)等等。以XOR为例,这种门会在恰好一半数量的输入为真的时候返回真值。具体来说,双输入版本的XOR可以用下面这个公式描述: \( Y=(A\oplus B)= (\overline {AB})+( A\bar{B}) \) ```python def xor_gate(a,b): return (not a and b) or (a and not b) ```
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