【最新技术早知道】PCIe Gen5 还没用上，Gen6 就来了？PCIe 6(1)

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✨ 2. PAM4 信号

传输信号采用 PAM4 四电平信号有点出乎人的意料，毕竟从 Gen1 到 Gen5 一直用得是 NRZ 二电平信号。不过想想 PAM4 也合情合理，再用 NRZ，这高频 Clock 就太难了。接下来再怎么搞我有点头疼，用 PAM16 也太难了吧，眼图都要瞎掉了。

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— 3️⃣ FLIT 编码 —

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✨ 3. FLIT 编码

FLIT Mode，流控单元模式，是一种1b/1b的编码方式。之前是以 TLP 为单位进行事务传输，PCIe 6.0 以 FLIT 为单位进行事务传输，每个 FLIT 有 256 B 数据（格式如 式1），每 B 数据占用 4 UI。以 x8 为例，一次 FLIT 传输的格式如图 1 所示。

1 FLIT = 236 B TLP + 6 B DLP + 8 B CRC + 6 B FEC = 256 B

（式1）

每个 FLIT 可以包含多笔 TLP，每笔 TLP 也可以拆分到多笔 FLIT。FLIT 中有 6 B DLP 数据（非DLLP），其中前 2 B 是留给 FLIT ACK / NAK / Replay 用的，取代了 Gen5 中采用 DLLP 的 ACK / NAK 机制。以 x16为例，由于不需额外规划 DLLP 的发送，这种在 FLIT 中加入 DLP 的 ACK / NAK 机制把相关时延从 ms 级降到了50 ns 以内，成效可观。只要开启了 FLIT Mode，即便数据速率从Gen6 调到 Gen1 ~ Gen5，仍然采用 FLIT 编码方式。

图1 x8 FLIT 格式

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— 4️⃣ 纠错 —

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✨ 4. 纠错

PCIe 6.0 引入了 FEC 前向纠错机制，并维持既有的 Retry 重传机制。在 PCIe Gen5 中，当 CRC 校验检测到 TLP 传输出错时，采用 Retry 机制进行重传。考虑到重传时延 <300 ns 且重传概率低于 10^-5，其对传输性能影响甚微。在 PCIe Gen6 中，对 Latency 的要求为 10 ns，仅采用 Retry 机制无法满足需求。在综合考量了FBER、FIT、FLIT Retry 概率、带宽效率、Latency 及 FLIT 的 FEC 能力后，PCIe Gen6 最终采用了低权重 FEC + Retry 的纠错方案。

采用单 Symbol 的 FEC 纠错机制，可以将 FLIT 解码时间压缩到 2 ns 以内。

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— 5️⃣ L0p 低功耗 —

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✨ 5. L0p 低功耗

如何实现更低功耗是个避不开的问题，PCIe 6.0 在既有低功耗状态 L0 / L0s / L1 / L2 基础上再加一个状态 L0p。PCIe 6.0 允许部分 Lane 进入 Electric Idle 状态、部分 Lane Active 仍然保持不中断的业务传输。当 Idle 状态的 Lane 想要重新 Active 时，只对这些 Lane 进行 Traning 握手，之前 Active 的 Lane 仍保持数据传输不间断。

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— 6️⃣ 新的机制 —

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✨ 6. 新的机制

PCIe 6.0 新加了几种机制：DOE、CMA、DMWr、IDE，删掉了 LN。

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— 参考 —

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📚 参考

1. PCI-SIG, “PCI Express base specification revision 6.0, version 0.9,” Beaverton, OR, USA, Oct 5, 2021.
2. D. Das Sharma, “PCI Express 6.0 Specification: A Low-Latency, High-Bandwidth, High-Reliability, and Cost-Effective Interconnect With 64.0 GT/s PAM-4 Signaling,” in IEEE Micro, vol. 41, no. 1, pp. 23-29, 1 Jan.-Feb. 2021, doi: 10.1109/MM.2020.3039925.
3. D. D. Sharma, “A low latency approach to delivering alternate protocols with coherency and memory semantics using PCI Express® 6.0 PHY at 64.0 GT/s,” 2021 IEEE Symposium on High-Performance Interconnects (HOTI), 2021, pp. 35-42, doi: 10.1109/HOTI52880.2021.00019.

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PCIe 6.0 系列文章：

• 【PCIe 6.0】颠覆性技术！你NRZ相守20年又怎样？看我PAM4如何上位PCIe 6.0 ！
• 【PCIe 6.0】PCIe 6.0 新特性 - L0p 详解
• 【PCIe 6.0】PCIe 6.0 新特性 - DMWr (Deferrable Memory Write) 详解
• 【PCIe 6.0】缘起缘灭缘终尽，花开花落花归尘——缅怀被PCIe 6.0拿掉的LN（Lightweight Notification）协议
• FLIT Mode（TODO）
• Error Detection & Correction（TODO）
• Shared Flow Control（TODO）
• DOE (Data Object Exchange)（TODO）
• CMA (Component Measurement and Authentication)（TODO）
• IDE (Integrity & Data Encryption)（TODO）
• 其他，待分配

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