IC设计ram002_ECC校验原理基础

1、ECC校验基础

Ram的ECC校验通常基于海明码编码原理实现，使用海明码编码需要额外的bit位存储校验位，ECC校验仅能纠正1bit的，无法纠正2bit以及以上数据错误，能发现部分多bit位错误的情况。

2、RAM ECC校验实现原理

如图所示为1r1w的ram为例，cfg_32x119_ram_wrapper为verilog代码直接调用层次的ram_wrapper，表示了一个深度为32，数据位宽为119bit的ram。ram_asic.v为真实的ram IP。其中119bit的数据位宽紧张ECC计算需要7bit的校验位，因此物理IP最少需要126bit的ram IP。通常memory产生工具会更具时钟频率，深度位宽等因素对ram进行切分，因此本例中，使用了2个32x64的ram ip。

在data_in写入ram_asic模块之前，会经过ecc_gen模块，产生7bit的ecc校验位，随着数据一同写入ram_asic，其中data_in[63:0]写入第一个ram_asic，{2’b0,ecc_in[6:0]，data_in[118:64]}写入第二个ram_asic。从ram_asic读出的数据会经过ecc_out模块经过ecc校验，输出校验后的data_out[118:0]和2bit的ecc_err_out告警。