FPGA实验3：D触发器设计

最新推荐文章于 2024-08-18 17:05:02 发布
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分类专栏： FPGA实验 文章标签： fpga开发
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一、实验目的及要求

  1. 熟悉Quartus II 的 VHDL 文本设计简单时序电路的方法；

掌握时序电路的描述方法、波形仿真和测试，特别是时钟信号的特性。

二、实验原理

运用Quartus II 集成环境下的VHDL文本设计方法设计简单时序电路——D触发器，依据D触发器的工作特性，进行波形仿真和分析、引脚分配并下载到实验设备上进行功能测试。

三、实验内容和步骤

实验步骤和方法参考实验一，引脚分配可参考下表。

引脚名称

引脚编号

连接网络

clk

PIN_T10

KEY1

d

PIN_M3

FPGA_M1

q

PIN_R10

LED1

 四、实验代码

 

x陌北x
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