FPGA学习笔记之电平标准

最新推荐文章于 2024-01-10 13:54:42 发布

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文章标签： fpga开发学习笔记

本文链接：https://blog.csdn.net/loveinsdu/article/details/132066743

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本文介绍了FPGA学习中的几种电平标准，包括TTL的单端输出、功耗大但速度快的COMS、抗干扰的LVDS和LVPECL（高速差分），以及TMDS针对HDMI视频传输和专用的SSTL/HSTL在DDR存储的应用。

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FPGA学习笔记之电平标准

TTL

三极管单端输出，像一般的USB转TTL。一根导线输出：3.3V/5V/0V。缺点是功耗大，翻转慢，传输率也是仅有几十M。

COMS

MOS管单端输出，这是目前常用的期间之一，功耗小，翻转快，一般传输速率<150MHZ都可以使用。

##LVDS

差分信号，两根导线输出，有抗干扰的能力。输出电压：2.5V/1.8V 。频率可达2G 实际使用300～400M。P端/N端。
注意事项：2.5V/1.8V在使用LVDS时，Bank供电一定为2.5或者1.8
若是3.3，只能接收，不能发送数据。

LVPECL

高速差分信号，差值较高，抗干扰的能力更强。
当外部输入为LVPECL，而FPGA为LVDS，硬件则需要电阻网络，将LVPECL转为LVDS。

TMDS

差分，针对HDMI视频传输

SSTL，HSTL

专用于DDR存储

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常用电平标准：现在常用的电平标准有TTL、CMOS、LVTTL、LVCMOS、ECL、PECL、LVPECL、RS232、RS485等，还有一些速度

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常用电平标准：现在常用的电平标准有TTL、CMOS、LVTTL、LVCMOS、ECL、PECL、LVPECL、RS232、RS485等，还有一些速度比较高的LVDS、GTL、PGTL、CML、HSTL、SSTL等。下面简单介绍一下各自的供电电源、电平标准以及使用注意事项。

FPGA之道——数字系统之间的接口电平标准

吉大秦少游

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3409

文章目录前言双阈值标准TTLLVTTLLVTTL3V3LVTTL2V5CMOSLVCOMSLVCOMS3V3LVCOMS2V5LVCOMS1V8LVCOMS1V5LVCOMS1V2LVDSRS232RS485不同标准之间能否混连？前言我们在对FPGA项目进行约束的时候，常常看到这样的电平标准，例如LVCOM18，LVCOS25，LVDS，LVDS25等等，其实这些都是一系列的电平标准，为了更加深刻地理解电平标准，下面摘选自《FPGA之道》这本书对于电平标准的讲解来理解。双阈值标准所谓的双阈值标准，是

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FPGA常用电平标准以及LVDS注意事项

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当外部输入LVPECL电平时，而FPGA是LVDS时，需要硬件使用电阻网络将LVPECL电平转换为LVDS电平；TTL：+5V/+3.3V为高电平，0为低电平，用三极管单端输出（串口模块：USB转TTL），大多几十兆。CMOS：MOS管单端输出，功耗低，反转快。单端：信号由一根导线输出，+5V/+3.3V为高电平，0为低电平。LVDS：低压差分信号，理论上最高频率2Ghz，大多几百兆。LVPECL：高速差分，PECL差值更大，抗干扰能力更强。差分：信号由两根导线输出，抗干扰能力强。

FPGA管脚约束之电平标准

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对FPGA的管脚进行约束的时候，常常看到这样的电平标准，例如LVCOM18，LVCOS25，LVDS，LVDS25等等，其实这些都是一系列的电平标准。针对数字电路而言，数字电路表示电平的只有1和0两个状态，在实际的电路中，需要约定什么样的电压为1，什么样的电压为0。数字电路中的双阈值是这样定义的，例如TTL接口电平标准：对于输出端，状态1的电压要求为大于等于2.4V，状态0的电压要求为小于等于0.5V；对于输入端，状态1的判定要求为大于等于2.0V，状态0的判定要求为小于等于0.8V；

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