FPGA学习笔记(一)__电平知识

常见电平标准

概述: 数字系统之间如果需要通信,就必须遵循相同的双阈值电平判定标准(什么条件时为1,什么条件时为0),以下介绍常见的电平标准。


1.TTL电平标准

  TTL(Transistor-Transistor Logic),晶体管-晶体管逻辑电平。
工作于TTL接口标准下的数字电路,其内部的有源器件的标准电源供给应为5V。输出输入如下:

输入逻辑1 的电压要求为大于或等于2.0V,逻辑0 的电压要求为小于或等于0.8V
输出逻辑1 的电压要求为大于或等于2.4V,逻辑0 的电压要求为小于或等于0.5V

对于输出、输入端的电压要求,可以看出输出端的电压输出要求要比输入端的双阈值判定标准更加严格,这样做主要是考虑到噪声的干扰以及电信号在输出与输入间的传输速度,从而让双阈值判定更加可靠,下同。

2.LVTTL电平标准

  由于2.4V到5V之间还有很大空间,这对改善噪声干扰并没有明显的提高,而且会增加系统的功耗,并且由于数字逻辑1、0之间电平相差较大,还会影响到数字电路的响应速度。所以产生了LVTTL-Low Voltage Transistor-Transistor Logic,即低压TTL电平标准。LVTTL又有LVTTL3V3和LVTTL2V5:

(1).LVTTL3V3

内部有源器件的标准电源供给为3.3V,如我们常用的部分单片机,输出、输入情况如下:

输入逻辑1 的电压要求为大于或等于2.0V,逻辑0 的电压要求为小于或等于0.8V
输出逻辑1 的电压要求为大于或等于2.4V,逻辑0 的电压要求为小于或等于0.4V

(2).LVTTL2V5

内部有源器件的标准电源供给为2.5V,输出、输入情况如下:

输入逻辑1 的电压要求为大于或等于1.7V,逻辑0 的电压要求为小于或等于0.7V
输出逻辑1 的电压要求为大于或等于2.0V,逻辑0 的电压要求为小于或等于0.2V

3.CMOS电平标准

  CMOS(Complementary Metal Oxide Semiconductor),这种接口电平标准初衷是用于基于CMOS、PMOS组成的MOS管结构的数字系统之间的。工作于CMOS接口标准下的数字电路,其内部有源器件电源供给为5V,输入输出如下:

输入逻辑1 的电压要求为大于或等于1.45V,逻辑0 的电压要求为小于或等于0.5V
输出逻辑1 的电压要求为大于或等于3.5V,逻辑0 的电压要求为小于或等于1.5V

COMS与TTL接口相比,有了更大的噪声容限,并且其输入阻抗也远大于TTL输入阻抗。

4.LVCOMS电平标准

  同TTL一样,鉴于功耗和响应速度的考虑,CMOS也同样衍生出了LVCOMS接口标准,并且由于COMS管相对于三极管的导通门限更加低,因此LVCOMS比LVTTL更容易使用较低的电压进行通信

(1).LVCOMS3V3

内部有源器件的标准电源供给为Vcc=3.3V

输入逻辑1 的电压要求为大于或等于2.0V,逻辑0 的电压要求为小于或等于0.7V
输出逻辑1 的电压要求为大于或等于3.2V,逻辑0 的电压要求为小于或等于0.4V

(2).LVCOMS2V5

内部有源器件的标准电源供给为Vcc=2.5V

输入逻辑1 的电压要求为大于或等于1.7V,逻辑0 的电压要求为小于或等于0.7V
输出逻辑1 的电压要求为大于或等于2.0V,逻辑0 的电压要求为小于或等于0.4V

(3).LVCOMS1V8

内部有源器件的标准电源供给为Vcc=1.8V,当然这是由一定容忍度的,与之前介绍的电平标准不同,这个容忍度会影响它的输入输出情况:

输入逻辑1 的电压要求为大于或等于0.65倍的Vcc,逻辑0 的电压要求为小于或等于0.35倍的Vcc
输出逻辑1 的电压要求为大于或等于Vcc-0.45V,逻辑0 的电压要求为小于或等于0.45V

如果Vcc精确为1.8V:

输入逻辑1 的电压要求为大于或等于1.17V,逻辑0 的电压要求为小于或等于0.63V
输出逻辑1 的电压要求为大于或等于1.35V,逻辑0 的电压要求为小于或等于0.45V

(4).LVCOMS1V5

内部有源器件的标准电源供给为Vcc=1.5V

输入逻辑1 的电压要求为大于或等于0.65倍的Vcc,逻辑0 的电压要求为小于或等于0.35倍的Vcc
输出LVCOMS1V5没有明确要求,但是肯定是逻辑1越接近Vcc越好,逻辑0越接近0V越好

如果Vcc精确为1.5V:

输入逻辑1 的电压要求为大于或等于0.975V,逻辑0 的电压要求为小于或等于0.525V
输出LVCOMS1V5没有明确要求,但是肯定是逻辑1越接近Vcc越好,逻辑0越接近0V越好

(5).LVCOMS1V2

内部有源器件的标准电源供给为Vcc=1.2V

输入逻辑1 的电压要求为大于或等于0.65倍的Vcc,逻辑0 的电压要求为小于或等于0.35倍的Vcc
输出LVCOMS1V2没有明确要求,但是肯定是逻辑1越接近Vcc越好,逻辑0越接近0V越好

如果Vcc精确为1.2V:

输入逻辑1 的电压要求为大于或等于0.78V,逻辑0 的电压要求为小于或等于0.42V
输出LVCOMS1V2没有明确要求,但是肯定是逻辑1越接近Vcc越好,逻辑0越接近0V越好

5.RS232

  RS232总线标准共设有25条信号线,RS232的标准电源供给为±12V或±15V

逻辑1-15~3V
逻辑03~15V

6.RS485

  RS485采用差分的形式来传递信息的,因此抗干扰要优于RS232。

逻辑1两线之间的电压差要求为2~6V之间
逻辑0两线之间的电压差要求为-6~-2V之间

7.CAN总线电平

  CAN总线电平基础电平为2.5V,上到3.5V,下到1.5V。

在这里插入图片描述

逻辑1 (隐性)CAN_H与CAN_L之间的电平差为2V
逻辑0 (显性)CAN_H与CAN_L之间的电平差为0V
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小梅哥在学习Xilinx FPGA期间进行了积极的探索,特别是对Cyclone V SOC的开发流程进行了学习。从裸机到基于Linux嵌入式系统,小梅哥实现了FPGA和ARM Cortex-A9 CPU之间的双向控制和数据传输。 在代码编写方面,小梅哥设计了一个名为mux2的模块,用于实现二选一多路器。模块包含了输入和输出端口,并通过assign语句实现了信号的赋值。 在激励文件中,小梅哥使用reg和wire定义了输入和输出信号,并通过mux2模块进行了实例化。然后,通过initial块生成了一系列的激励信号,对模块进行仿真。 总结来说,小梅哥在Xilinx FPGA学习笔记中记录了自己对Cyclone V SOC的学习、代码编写和激励文件的使用。这些学习内容对于理解FPGA开发流程以及实现特定功能非常有帮助。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* [FPGA自学笔记——设计与验证VIP版.pdf](https://download.csdn.net/download/qq_30307853/11656682)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 50%"] - *2* *3* [小梅哥Xilinx FPGA学习笔记1——二选一多路器](https://blog.csdn.net/weixin_42454243/article/details/122026484)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]
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