版图DRC验证

Diva DRC验证

  1. 首先将diva的所有规则文件复制到设计库目录
  2. 点击verify-drc
  3. 设置switch names(all), rules files,rules library,machine(local)
  4. 使用verify-masker-explain点击高亮框显示错误提示。

Dracula DRC验证

  • DIVA 简单易用,过程完整较大规模的版图验证速度很慢
  • Dracula 运算速度很快,功能强大;能提取和验证较大电路

DRC流程如下图

DRC流程图

具体步骤

  1. 复制验证文件
    创建DRC文件夹
    复制规则文件 dracula.drc到工作目录
  2. 生成版图gds文件:File-Export-Stream;stream out窗口中的gds名称要与单元名称一致,路径也是drc的工作路径;其他的选项对应选择我们设计的单元,最后点击translate
  3. 修改规则文件:indisk后改为刚刚生成的gds文件(.gds),primary后改成gds文件中的单元名。保存退出。
  4. 预运行:在终端中输入PDRACULA,路径为工作目录drc;在PDRACULA中输入/g 验证文件名;完成后输入/f
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Cadence是一种流行的EDA(电子设计自动化)软件,用于设计电路版图和执行 DRC(制造规则检查)。Cadence软件提供了强大的功能和工具,可以帮助电路工程师设计复杂的电路,并确保设计符合制造规则。 当设计电路版图时,我们首先需要选择适当的器件和元件来构建电路。Cadence提供了一个库,其中包含了各种各样的器件和元件,包括晶体管、电容、电阻等。我们可以从这个库中选择并拖放这些器件到版图中,并通过连接线连接它们以形成一个完整的电路。 设计完成后,我们需要执行DRC来确保设计符合制造规则。DRC是一个必要的步骤,因为制造规则包含了与电路在物理上布局有关的限制。通过执行DRC,我们可以检查电路版图是否满足这些限制,并在需要时做出调整。 在Cadence中执行DRC是相对简单的。我们首先需要设置DRC规则,这些规则通常由制造商提供。然后,我们可以运行DRC检查来验证电路版图。检查过程中,Cadence会检查元件的间距、线宽、层间间隔、电连通性等。如果检查结果显示有违反制造规则的地方,Cadence会生成相应的错误报告,指出具体的问题所在。 通过使用Cadence的设计电路版图和执行DRC功能,我们能够更轻松地设计复杂的电路,并确保设计与制造规则相符。这可以帮助我们节省时间和精力,并最大限度地提高电路的可靠性和性能。
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