华为海思数字芯片设计笔试第六套

声明

下面的题目作答都是自己认为正确的答案，并非官方答案，如果有不同的意见，可以评论区交流。
这些题目也是笔者从各个地方收集的，感觉有些题目答案并不正确，所以在个别题目会给出自己的见解，欢迎大家讨论。
因为这里我只会设计的题目，所以验证的题目我就没放上去了

题目

1．以下低功耗措施中，哪种不是降低电路翻转率的方法?
A.在不进行算术运算的时候，使这些模块的输入保持不变，不让新的操作数进来
B.采用 Gray 码或 One‐hot 码作为状态机编码
C.减少电路中的 glitch
D.重新安排“if‐else”表达试，可将毛刺或快变化信号移至逻辑锥体的前部
正确答案：D

2.以下 Verilog 代码中，a=12，b=10.则 z 的运算结果为:
Input [3:0]a;
Input [3:0] b;
output signed [7:0] z;
wire signed [3:0]c;
assign c= a[3:0]*b[3:0];
assign z=c;
A.120
B.‐8
C.8
D.‐120
’d120=7‘b1111000=-8
正确答案：B

5．下面有关 Cache 的说法哪一个是不正确的?
A. 设置 Cache 的理论基础，是程序访问的局部生原理
B. Cache 与主存统一编址，Cache 的地址空间属于主存的一部分
C. 设置 Cache 的目的，是解决 CPU 和主存之间的速度匹配问题
D. Cache 的功能匀由硬件实现，对程序员是透明的
解析：
A：使用 Cache 改善系统性能的依据是程序的局部性原理 [1]
B：cache 的地址与内存地址是两码事，不统一编址，也没有从属关系
C：Cache 是介于 CPU 和主存之间的小容量存储器，存取速度比主存快，接近 CPU。它能高 速地向 CPU 提供指令和数据，提高程序的执行速度。Cache 技术是为了解决 CPU 和主存之 间速度不匹配而采用的一项重要技术。
D：Cache 是主存的缓冲存储器，由高速的 SRAM 组成，所有控制逻辑全部由硬件实现，对
程序员而言是透明的。随着半导体器件集成度的不断提高，当前有些 CPU 已内置 Cache，并 且出现了两级以上的多级 Cache 系统。 Cache 通常采用相联存储器。Cache 又分为 L1Cache（一级缓存）和 L2Cache（二级缓存），
L1Cache 主要是集成在 CPU 内部，而 L2Cache 集成在主板上或是 CPU 上。
正确答案：B

6.对于独立复位的模