modelsim仿真
qq_44554964
这个作者很懒,什么都没留下…
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使用Quartus 18.0 的NCO ip核产生一个正弦信号,并用modelsim仿真(解决asj文件not define 问题)
使用Quartus 18.0 的NCO ip核产生一个正弦信号NCO ip核的参数设置.v文件的内容module nco_test(clk,reset_n,clken,phi_inc_i,fsin_o,out_valid); input clk; input reset_n; input clken; input [15:0] phi_inc_i; output [9:0] fsin_o; output out_valid; nco_ip u1( .cl原创 2020-12-08 20:42:13 · 6309 阅读 · 7 评论 -
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FPGA中浮点数与定点数的转化原理与转化方法(并使用乘法器进行两个定点数的相乘)基础知识什么是浮点数与定点数浮点数转换为定点数浮点数与定点数的相乘在quartusⅡ中使用乘法器完成两个定点数相乘IP核的使用.v文件与测试未见do文件仿真结果基础知识什么是浮点数与定点数浮点数:小数点是浮动的,不是在一个固定的位置上的定点数:小数点的位置是固定的在FPGA内部只能处理定点数无法处理浮点数当浮点数转换成定点数的时候要明确的知道小数有多少位,整数有多少位浮点数转换为定点数3位整数位宽,12位的小数位原创 2020-07-16 15:43:45 · 5959 阅读 · 1 评论 -
学习调用ISE的FIFO IP核(包含ISE IP核文件的 do文件仿真)
学习调用ISE的FIFO IP核FIFO是什么使用ISE调用与设置FIFO的IP核.v文件的书写与例化FIFO是什么fifo: First Input First Output的缩写,先入先出队列,这是一种传统的按序执行方法,先进入的指令先完成并引退,跟着才执行第二条指令。fifo说直白了其实就是一个RAM,只是读写数据的顺序有了规定。一般用于不同时钟域之间的数据传输,当然这种情况下就是异步RAM同步RAM指的是输入和输出使用的是同一个时钟或者同频时钟使用ISE调用与设置FIFO的IP核step原创 2020-07-10 17:05:26 · 5803 阅读 · 0 评论 -
超详细的quartusⅡ调用PLL IP核过程与原理讲解,实现倍频
超详细的quartusⅡ调用PLL IP核过程与原理讲解,实现倍频任务要求quartusⅡ 调用pll ip核的过程ip核的选择ip核参数的设置模式的选择后续ip核参数设置编写.v文件、测试文件与do仿真文件编写.v文件编写测试文件编写do文件仿真结果任务要求输入为50MHz的时钟信号,要求使用pll 产生一个150MHz核80MHz的输出信号,并包含90度与80度的相移quartusⅡ 调用pll ip核的过程ip核的选择首先选择ip核,在右边的 IP-Catalog目录里输入PLL,选择ALT原创 2020-06-28 22:59:08 · 10956 阅读 · 3 评论 -
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使用modelsim do文件进行仿真的基本操作与modelsim do文件的基本语句,以及常见错误modelsim do文件的写法写do文件时一些需要注意的地方添加波形时的注意事项do文件的语法常见错误do文件操作的流程modelsim do文件的写法#这个do文件一边都放在仿真激励文件的目录下#此处是注释#退出现有工程quit -sim#清除命令行显示信息 .main clear#在根目录下建立了一个lib的文件夹,这个根目录其实就是指和我们当前文件在同一个文件夹下vlib ./原创 2020-06-26 16:59:12 · 3065 阅读 · 1 评论