Quartus IP核
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这个作者很懒,什么都没留下…
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很详细的Quartus软件的SignalTap 使用教程
SignalTap 使用教程SignalTap 的原理SignalTap 与外部逻辑分析仪功能类似,主要用来分析数据的变化。但 SignalTap II 是利用 FPGA 内部的逻辑单元以及 RAM 资源实时地捕捉和显示实时信号,所以需要消耗一定的 FPGA 内部资源。与 Modelsim 仿真不同之处在于,SignalTap II 要与硬件结合,程序在 FPGA 中运行,实时显示真实的数据。可以选择要捕捉的内部信号 ,触发条件,捕捉的时间,捕捉多少数据样本等,帮助工程师查看实时数据进行 debug。原创 2020-12-09 17:51:38 · 18133 阅读 · 2 评论 -
使用IP核时遇到输出有效信号无法拉高情况下的解决方法
使用赛灵思的PLL IP核与quartus的 NCO IP核时,输出信号正常,但是对应的数据有效信号如PLL中的locked信号与NCO IP核中的out_valid信号没有拉高,没有拉高显然不对,我的解决方法是在测试文件中复位信号拉高时间尽可能的长一些,在一开始,复位信号为0,当我10ns之后拉高时,数据有效信号始终无法拉高,当我i100ns之后再将复位信号拉高时,数据有效信号就可以被拉高,结果正确。...原创 2020-12-09 09:53:07 · 646 阅读 · 0 评论 -
使用Quartus 18.0 的NCO ip核产生一个正弦信号,并用modelsim仿真(解决asj文件not define 问题)
使用Quartus 18.0 的NCO ip核产生一个正弦信号NCO ip核的参数设置.v文件的内容module nco_test(clk,reset_n,clken,phi_inc_i,fsin_o,out_valid); input clk; input reset_n; input clken; input [15:0] phi_inc_i; output [9:0] fsin_o; output out_valid; nco_ip u1( .cl原创 2020-12-08 20:42:13 · 6236 阅读 · 7 评论 -
FPGA中浮点数与定点数的转化原理与转化方法(并使用乘法器进行两个定点数的相乘)
FPGA中浮点数与定点数的转化原理与转化方法(并使用乘法器进行两个定点数的相乘)基础知识什么是浮点数与定点数浮点数转换为定点数浮点数与定点数的相乘在quartusⅡ中使用乘法器完成两个定点数相乘IP核的使用.v文件与测试未见do文件仿真结果基础知识什么是浮点数与定点数浮点数:小数点是浮动的,不是在一个固定的位置上的定点数:小数点的位置是固定的在FPGA内部只能处理定点数无法处理浮点数当浮点数转换成定点数的时候要明确的知道小数有多少位,整数有多少位浮点数转换为定点数3位整数位宽,12位的小数位原创 2020-07-16 15:43:45 · 5839 阅读 · 1 评论 -
使用quartusⅡ调用ROM或RAM IP核
使用quartusⅡ调用ROM或RAM IP核ROM IP核的使用IP核的调用过程调用IP核ROM初始化仿真ROM IP核的使用常常用来实现从快速时钟域到慢速时钟域的处理或慢速时钟域到快速时钟域的处理。对于一些数据可以先不发出,先把它存储起来,等到了一定的数目再发出。ROM只能读出数据,不能写入数据。在进行ip核名命的时候一定要注意规范 比如我们数据的存储宽度为8位,存储深度为256 则命名的名字为rom_8_256,rom是要进行初始化的,常常使用hex文件或mif文件对ROM进行初始化IP核的调用原创 2020-07-08 16:52:01 · 16857 阅读 · 2 评论 -
使用ISE DDS IP核产生正弦信号
使用ISE DDS IP核产生正弦信号使用ISE DDS IP核产生正弦信号配置DDS IP核生成verilog代码新的改变功能快捷键合理的创建标题,有助于目录的生成如何改变文本的样式插入链接与图片如何插入一段漂亮的代码片生成一个适合你的列表创建一个表格设定内容居中、居左、居右SmartyPants创建一个自定义列表如何创建一个注脚注释也是必不可少的KaTeX数学公式新的甘特图功能,丰富你的文章UML 图表FLowchart流程图导出与导入导出导入使用ISE DDS IP核产生正弦信号任务要求为 输入时原创 2020-06-16 20:38:20 · 7012 阅读 · 1 评论 -
超详细的quartusⅡ调用PLL IP核过程与原理讲解,实现倍频
超详细的quartusⅡ调用PLL IP核过程与原理讲解,实现倍频任务要求quartusⅡ 调用pll ip核的过程ip核的选择ip核参数的设置模式的选择后续ip核参数设置编写.v文件、测试文件与do仿真文件编写.v文件编写测试文件编写do文件仿真结果任务要求输入为50MHz的时钟信号,要求使用pll 产生一个150MHz核80MHz的输出信号,并包含90度与80度的相移quartusⅡ 调用pll ip核的过程ip核的选择首先选择ip核,在右边的 IP-Catalog目录里输入PLL,选择ALT原创 2020-06-28 22:59:08 · 10712 阅读 · 3 评论