AXI-LITE使用教程（一）

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目录

前言

一、AXI-LITE特性

单通道操作：

简单的地址和数据握手机制：

低资源占用：

易于集成：

二、典型应用

1.寄存器配置：

2.低速控制接口：

3.SoC中的集成：

三、AXI-Lite接口信号

四、基本结构

五、握手顺序

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前言

AXI-Lite（AXI4-Lite）是ARM推出的AXI（Advanced eXtensible Interface）协议的一种简化版本，主要用于控制寄存器访问和低吞吐量数据传输。

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一、AXI-LITE特性

• 单通道操作：

  • AXI-Lite只支持单通道的读写操作，适用于简单的寄存器访问，不支持突发传输（burst transfers）。

• 简单的地址和数据握手机制：

  • 使用简单的握手机制进行地址和数据传输，数据通道宽度固定为32位或64位。

• 低资源占用：

  • 由于不支持复杂的突发传输，AXI-Lite占用的资源更少，非常适合资源受限的系统。

• 易于集成：

  • AXI-Lite接口设计简单，易于与其他AXI接口集成，特别是在需要与复杂的AXI4主设备或从设备通信时。

二、典型应用

1.寄存器配置：

• AXI-Lite通常用于系统中寄存器的配置和状态读取，如微处理器对外设的配置寄存器进行读写操作。

2.低速控制接口：

• 适用于传输速率较低的控制接口，比如控制GPIO（通用输入输出）、UART（通用异步收发传输器）等外围设备。

3.SoC中的集成：

• 在片上系统（SoC）中，用于不同模块之间的简单、低速的数据和控制信号传输。

注：AXI-Lite由于其简单、低资源占用和易于集成的特性，广泛应用于需要基本寄存器读写操作和控制信号传输的场景中。

三、AXI-Lite接口信号

AXI-Lite协议包括以下主要信号：

• 写地址通道（Write Address Channel）：

  • AWVALID：写地址有效信号。
  • AWREADY：从设备准备好接收写地址信号。
  • AWADDR：写地址信号。

• 写数据通道（Write Data Channel）：

  • WVALID：写数据有效信号。
  • WREADY：从设备准备好接收写数据信号。
  • WDATA：写数据信号。

• 写响应通道（Write Response Channel）：

  • BVALID：写响应有效信号。
  • BREADY：主设备准备好接收写响应信号。
  • BRESP：写响应信号。

• 读地址通道（Read Address Channel）：

  • ARVALID：读地址有效信号。
  • ARREADY：从设备准备好接收读地址信号。
  • ARADDR：读地址信号。

• 读数据通道（Read Data Channel）：

  • RVALID：读数据有效信号。
  • RREADY：主设备准备好接收读数据信号。
  • RDATA：读数据信号。
  • RRESP：读响应信号。

四、基本结构

五、握手顺序

1. 主设备在断言 ARVALID 前不需要等待 ARREADY：

   主设备应主动断言 ARVALID 信号，不需要等待从设备表示它准备好了。

2. 从设备可以在 ARVALID 被断言后再断言 ARREADY：

   从设备可以选择在检测到 ARVALID 信号后，再表示自己准备好了接收读地址。

3. 从设备可以在 ARVALID 被断言前就断言 ARREADY：

   从设备也可以提前表示自己准备好了接收读地址，而不必等待主设备断言 ARVALID。

4. 从设备必须在 ARVALID 和 ARREADY 都断言后再断言 RVALID：

   从设备必须等到读地址握手完成后（即 ARVALID 和 ARREADY 都被断言）再表示数据已准备好。

5. 从设备在断言 RVALID 前不需要等待 RREADY：

   从设备在数据准备好后，应立即断言 RVALID 信号，不需要等待主设备表示它准备好接收数据。

6. 主设备可以在 RVALID 被断言后再断言 RREADY：

   主设备可以选择在检测到 RVALID 信号后，再表示自己准备好了接收数据。

7. 主设备可以在 RVALID 被断言前就断言 RREADY：

   主设备也可以提前表示自己准备好了接收数据，而不必等待从设备断言 RVALID。

这些规则确保了在读事务中，主设备和从设备之间的信号交换和数据传输能够正确进行。

注：单箭头表示着一个信号可以在另一个信号之前或之后断言。双箭头表示该信号必须按顺序断言。