FPGA之状态机

文章介绍了状态机设计的四个基本步骤:定义状态空间,设置状态跳转的敏感列表,通过组合逻辑判断下一个状态,以及在各状态下执行的动作。独热码编码被详细阐述,这是一种确保在任何时候只有一个状态激活的编码方式,对于6个和16个状态的情况,分别给出了二进制和简化后的十六进制表示。
摘要由CSDN通过智能技术生成

状态机设计步骤:

    1、状态空间的定义

          状态空间:所有状态的集合

           独热码:译码逻辑简单,每个状态只有一个寄存器置位。

     2、状态跳转

           敏感列表:时钟信号以及复位信号边沿的组合

     3、下个状态的判断(组合逻辑):使用阻塞赋值(=)

     4、各状态下的动作

独热码:又称一位有效编码,其方法是使用N位状态寄存器来对N个状态进行编码,每个状态都有它独立的寄存器位,并且在任意时候,其中只有一位有效。例如,有6个状态的独热码状态编码为:000001,000010,000100,001000,010000,100000。有十六个状态的独热码状态编码应该是:0000000000000001,0000000000000010,0000000000000100,0000000000001000,0000000000010000,0000000000100000 ,……,10000000000000000。但是通常我们为了方便书写,将二进制简化为十六进制表示(从右往左每四位二进制位用一位十六进制数表示),那么,以上十六状态的独热码可以表示成0x0001, 0x0002, 0x0004, 0x0008, 0x0010, 0x0020, ……, 0x8000(其中的0x是十六进制的前缀表示,在诸如PLC等程序中也有其他表示方法)。

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