数字电子技术基础(二十五)——TTL门电路的电压传输特性以及输入噪声容限

目录

 1 电压传输特性

2 TTL门电路的输入端噪声容限


 1 电压传输特性

在TTL门电路中,核心是将输入电压转换为输出电压,通过对于电压传输特性进行验证,可以判断电路是否按照预期工作,确保逻辑是否正确。如下所示为测试电压传输特性的实验电路:

图1 测试电压传输特性的实验电路

门电路的电压传输特性描述了输出电压V_O随着输入电压V_I变化的规律,将这个与非门的A输入端接高电平,构成了一个与非门的测试电路,由直流电压源V_{CC}和电位器R_L构成的分压器结构正好为与非门的B输入端提供了可调的输入电压,调节输入电压。如下所示为此时与非门模拟开关示意图:

图2 输入电压小于0.7V时与非门的模拟开关示意图

当输入电压低于0.7V的时候,相当于低电平的输入,输入级的晶体管T_1所对应的发射结必须导通,T_1的基级电位V_B此时低于1.4V,这个基级无法令T_2T_4导通,所以T_2T_4处于截止状态,推拉式输出级的晶体管T_3和二极管D_1导通,输出为稳定的高电平信号,由于此时在推拉式输出级当中,晶体管T_4处于截止状态,因此我们将特性曲线当中AB称为截止区。如下图所示为当输入电压小于0.7V时电压传输特性的特性曲线示意图:

图3 输入电压传输特性的特性曲线(输入电压小于0.7V)

继续调试输入电压,当输入电压增加到0.7V<V_I<1.4V时,T_1的集电极电位V_B仍然低于2.1V,此时T_2开始由截止区到放大状态,而此时T_4处于截止状态,随着T_2进入到放大状态,它的输出电流集电极电流开始增加,而集电极电流在电阻R_2身上的压降也随着增加,这就意味着T_2的集电极电位V_{C2}也开始下降,而此时工作于射级跟随状态的晶体管T_3,它的输出随着自身的输入V_{C2},开始线性下降。如下图所示为此时电路的模拟开关图:

图4 输入电压大于0.7V小于1.4V时与非门的模拟开关示意图

此时输出电压随着输入电压的增加,进入到特性曲线的线性的BC段。如下图所示:

图5 TTL门电路电压传输特性曲线图(小于1.4V)

当输入电压增加到接近1.4V的时候,晶体管T_1的基级电位V_B约为2.1V,这个2.1V的基级电位意味着此时T_2T_4同时导通,而晶体管D_1处于截止状态,如下图所示为此时电路的模拟开关图:

图6 输入电压接近1.4V时与非门的模拟开关示意图

此时门电路的输出电位急剧地下降为低电平信号,将特性曲线中CD段称为转折区。如下图所示:

图7 TTL门电路电压传输特性曲线图(接近1.4V)

继续调整输入电压,随着输入电压的增高,可以看到输出电压基本保持不变,进入到特性曲线的饱和区的DE段,如下图所示为进入到曲线的饱和区DE段:

图8 TTL门电路电压传输特性曲线图

在这个电压传递特性曲线中,转折去CD段的中点所对应的输入电压,称之为阙值电压,这个阙值电压是用来区分推拉式输出级的晶体管T_4是处于饱和导通状态还是截止状态的分界值,因而阙值电压也被称为门槛电压。如下图所示为电压传输特性曲线图:

图9 电压传输特性曲线图

在上图中V_{IH}中为阙值电压,即输入电压高于阙值电压时,电路会识别为高电平,输入电压低于阙值电压时,电路会识别为低电平。

为了明确区分数字电路中的1和0,不仅规定了门电路输出电平的高、低界限,在这个非门测试电路的电压传递特性曲线当中还规定了输入端高、低电平的界限与低电平输出最大值,相对应的输入电平称为开门电平,大约有1.5V,这就意味着当V_I高于V_{OH}的时候,门电路相当于输入了高电平,非门输出V_O相当于"开态"。与这个输出高电平的下限值所对应的输入电平称为关门电平,大约为1.3V,当V_I低于V_{OFF}的时候,相当于时可靠的低电平输入,非门的输出V_O为高电平,门电路相当于"关态"。

如下图所示:

图10 TTL门电路电压传输特性曲线图

问了保证门电路的抗干扰能力,用74系列的电路的标准参数输入高电平的下限值和输入低电平的上限值,分为代替门电路中的关门电平和开门电平。

(图7、图8、图9和图10参考了阎石、王红主编的《数字电子技术基础》内容)

2 TTL门电路的输入端噪声容限

在有多个门电路构成的电子系统中,上一级的输出是下一级的输入,这个过程中很可能会有干扰信号进来。在实际电路中要保证门电路的高、低电平基本不变的情况下,门电路的输入端和输出端要保持在允许波动的范围。如下图所示:

图11 TTL门电路的输入端噪声容限示意图

在输入端逻辑1和逻辑0对应高、低电平的变化范围要比输出端高、低电平的变化范围要宽得多。其中高电平的噪声容限为:V_{NH}=V_{OH(min)}-V_{IH(min)}。低电平的噪声容限则是用低电平输入与输出的上限值之差来表示的,低电平的噪声容限为:V_{NL}=V_{IL(max)}-V_{OL(max)}

(本文参考了哈尔滨工业大学《数字电子技术基础》课程内容)

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