这里16bit模式,在端口只有32bit,所以高位填0,只有低16bit数据有效。在内部形成校验数据时以这种
填充后的32bit数据来形成校验位。
写命令下:
在写模块之前,内部数据通道是64bit,在写模块下,基于(32,7)编码形成两个7bit
共14bit的校验位,在写模块内部,把64bit数据拆成四个16bit,再高位填16bit填0成4个32bit,
基于这四个32bit分别生成各自的校验位,然后在DDR2端口把这四个32个数据分别写出。为了保持
写带宽的一致性,64bit的时钟频率是端口时钟频率的1/4
DDR2的ECC处理办法之二
最新推荐文章于 2024-01-22 15:47:22 发布