Verilog 基础语法03 -- 标识符

已于 2022-01-29 22:56:04 修改
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分类专栏： FPGA 文章标签： fpga开发
于 2022-01-29 22:49:52 首次发布
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标识符( identifier）用于定义模块名、端口名、信号名等。

标识符可以是任意一组字母、数字、$符号和_(下划线)符号的组合；

但标识符的第一个字符必须是字母或者下划线；

标识符是区分大小写的；

标识符推荐写法

不建议大小写混合使用；

普通内部信号建议全部小写；

信号命名最好体现信号的含义，简洁、清晰、易懂；

以下是一些推荐的写法：

  1、用有意义的有效的名字如 sum 、cpu_addr等。

  2、用下划线区分词，如cpu_addr。

  3、采用一些前缀或后缀，比如时钟采用clk前缀：clk_50，clk_cpu；

s375527511
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内容 在 Verilog HDL中，标识符（ Identifier）被用来命名信号名、模块名、参数名等，它可以是任意一组字母、数字、$符号和（下划线）符号的组合。应该注意的是，标识符的字母区分大小写，并且第一个字符必须是字母或者下划线。 以下标识符是合法的： 以下标识符是不合法的： 为了使用标识符集合以外的字符或标号， Verilog HDL规定了转义标识符。采用转义标识符可以在一条标识符中包含任何可打印的字符。转义标识符以“\”（反斜线）符号开头，以空白结尾（空白可以是一个空格、一个制表字符或换行符）
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Verilog HDL中的标识符( i d e n t i f i e r )可以是任意一组字母、数字、 $符号和_(下划线)符号的 组合，但标识符的第一个字符必须是字母或者下划线。另外，标识符是区分大小写的。以下 是标识符的几个例子： C o u n t COUNT / /与C o u n t不同。 _ R 1 _ D 2 R 5 6 _ 6 8 F I V E $ 转义标识
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