ModelSim入门

本文介绍了如何入门使用ModelSim ALTERA 6.4a进行verilog设计仿真,包括安装过程中的问题解决,如以管理员身份运行。同时讲解了Testbench的基本语法,并给出一个8位比较器的测试模块,通过全面的测试覆盖所有可能的输入情况,以确保设计的正确性。
摘要由CSDN通过智能技术生成

verilog设计进阶

时间:2014年5月5日星期一

 

主要收获:

1.安装了ModelSim ALTERA  6.4a;

2.熟悉基本流程,仿真成功;

3.了解testbench语法基本。

 

为什么要学ModelSim……

1.Modelsim是专业的HDL语言仿真器,比Quartus自带的仿真器功能强大的多.

2.Quartus simulator不支持Testbench ,只支持波形文件.vwf。vwf文件全称是矢量波形文件(Vector Waveform File),是Quartus II中仿真输入、计算、输出数据的载体。一般设计者建立波形文件时,需要自行建立复位、时钟信号以及控制和输入数据、输出数据信号等。其中工作量最大的就是输入数据的波形录入。比如要仿真仅1KB的串行输入数据量,则手工输入信号的波形要画8000个周期,不仅费时费力而且容易出错。

 

安装遇到的问题……

由于笔记本是win8系统,安装的是ModelSim ALTERA 6.4a,破解之后仍然打不开。解决的方法是……以管理员的身份打开。

 

可综合的比较器:

modulecompare(a, b, equal);

  input a;

  input b;

  output equal;

  assign equal = (a==b)?1:0;

endmodu

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