静态时序分析13——总结篇

1、熟悉timing report

拿到timing path先不要看有没有timing violation ,要看

  • startpoint、endpoint
  • common cell点
  • launch path、capture path
  • CRPR
  • library setup time
  • 周期检查对不对
  • 同沿检查
  • 一个周期检查
  • 反标对不对

看看时序报告有没有什么奇怪的问题,然后再看是否meet timing

2、熟悉PT工具指令(有助于debug)

例如读design,读SPEF、做时序分析,做时序收敛、STA分析指令

3、流程

怎么跑一个时序分析:

  • read design、read library 、link 、读SPEF、读 OCVderatin设置
  • update timing
  • report timing

前期理论知识熟练再做流程。

一般进入公司,这些基本流程公司内部已经搭建好了,工程师做的最多的是:

  • 时序分析,分析这是真path还是假path,有没有timing violation
  • 时序收敛,一旦有timing violation,怎么进行timing fix

养成看timing path习惯,熟悉指令方便debug 

5、timing signoff设置

每家公司和每家工具变量设置很多(例如环境变量、内部变量),这都会影响最终分析的准确性(一般是经验丰富的工程师去和foundry厂沟通,注重积累经验)

6、对于一个后端工程师,要看各个工具的userguide。

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data to data的时序分析是一种用于验证数字设计时序的技术。它主要用于需要明确两对应信号之间到达时间的自定义模块。一个常见的情况是数据信号被使能信号控制,因此需要确保数据信号在使能信号到达之前是稳定的。时序分析可以通过设置数据检查约束来实现,例如使用set_data_check命令进行约束设置。在时序分析中,可以使用setup check和hold check来验证数据信号的到达时间。\[1\]\[2\]时序分析是验证设计中各种时序问题的一种方法,另外一种方法是时序仿真。时序分析的目的是同时验证功能和时序,以确保设计的正确性和稳定性。\[3\] #### 引用[.reference_title] - *1* *2* [静态时序分析——Data to data check](https://blog.csdn.net/qq_21842097/article/details/108331946)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insert_down28v1,239^v3^insert_chatgpt"}} ] [.reference_item] - *3* [STA静态时序分析](https://blog.csdn.net/qq_44933149/article/details/126430341)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insert_down28v1,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]

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