FPGA 入门实验2: 译码器组合逻辑

2-4译码器

实验要求

放置2个2-4译码器模块,则总共有2组SW, 每组2个,2组LED,每组4个,每组SW分别控 制其对应的LED组。

实验代码

在这里插入图片描述

管脚配置

在这里插入图片描述

板级调试

在这里插入图片描述

3-8译码器

实验要求

参照代码,设计一个3-8译码器,完成类似 的拨码开关实验。注意代码中的信号宽度设定。

实验代码

verilog代码
在这里插入图片描述
BDF顶层文件
在这里插入图片描述

管脚分配

在这里插入图片描述

板级调试

在这里插入图片描述

7段译码器

实验要求

自行查阅手册中的7段译码器管脚对应关系, 用4个拨码开关控制一个7段译码器的数字,从 0-9-A-F,共16个数字和字母

实验代码

verilog代码
在这里插入图片描述
BDF顶层文件
在这里插入图片描述

管脚分配

在这里插入图片描述

板级调试

在这里插入图片描述
在这里插入图片描述至此完成实验2的入门实验。

评论
添加红包

请填写红包祝福语或标题

红包个数最小为10个

红包金额最低5元

当前余额3.43前往充值 >
需支付:10.00
成就一亿技术人!
领取后你会自动成为博主和红包主的粉丝 规则
hope_wisdom
发出的红包
实付
使用余额支付
点击重新获取
扫码支付
钱包余额 0

抵扣说明:

1.余额是钱包充值的虚拟货币,按照1:1的比例进行支付金额的抵扣。
2.余额无法直接购买下载,可以购买VIP、付费专栏及课程。

余额充值