verilog的经典电路详解

经典的电路的控制

例如 :spi 控制器

  1. 文档 design spec
    (1) IO postlist
    (2) feature list
    (3) 框图:对其进行分解,分隔 ,查看每个模块接口都有那些信息
    设计人员 : 对自己的代码心里有数

全加器

在这里插入图片描述
提供进位输出,支持1bt 运算,支持进位输入
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module fulladder(Cout,Sum,Ain ,Bin ,cin)
assign Sum= Ain ^ bin ^ cin
assign count = (Ain &bin)......
卡诺图的化简

testbench

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例化

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通过上述可能就可以继续仿真

仿真

采用qustasim的方式进行仿真

具体操作方式请见看Questa Sim pdf文件

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四选一选择器

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这里使用one - hot编码 :优势,对于一位有效的情况

计数器

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