UVM平台，问题总结

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验证：
1.uvm和dut之间接口是什么？uvm内部接口是啥？   
interface/TLM
2.UVM平台架构和运行机制？        

架构包括seqencer、driver、dut、monitor、rf、scorboard，运行机制为phase运行机制，clase内部顺序执行，clase之间并行执行

3.sequnce启动方式？   
自启动和手动启动 
5.phase分为task和function，区别是什么？
function有返回值，task没有
function不能消耗仿真时间，所以function中不可以等待或者延时。但是task可以消耗时间

task可以调用function，function不能调用task
6.用户自定义的phase是否会自动执行？
系统定义的phsase按顺序从上往下执行，自定义phase只有在系统定义的phsase中调用，才会执行
7.uvm_config_db用法   
用于在顶层修改内部模块信号值
8.uvm_info/uvm_warning/uvm_erro/uvm_fatal 区别
uvm_fatal报错后回停止，其他不会
9.’uvm_object_utils/’uvm_component_utils
类注册
10.creat和new的区别

create是用factory模式来construct对象，在factory中注册过的uvm_object扩展类或是uvm_component 扩展类都可以用create，这样做的好处是在testcase里面可以override. 　new是什么时候都可以用的

11.this关键字和super关键字

super用来获取超类的成员变量、函数等，this作用是先在当前作用域内寻找对应的参数，接着在上一级作用内寻找，直到找到该变量为止.

12driver默认port.

seq_item_port/rsp_port/uvm_analysis_port,

13.fifo默认port

uvm_tlm_analysis_fifo/analysis_export/blocking_get_export

14.uvm_analysis_port/uvm_blocking_get_port

15 fork join/fork joinnone/fork jionany 区别

16.assert

立即断言和并发断言；

17.uvm停止运行机制
raise  drop
18.uvm_componet_utils/uvm_object_utils    sequencer和sequence的区别
uvm树上用componet。其他用object
componet内部用phase机制运行，object内部用body
19覆盖率包括哪几种
代码覆盖率
功能覆盖率  covergroup
断言覆盖率