第8篇：串行进位加法器

已于 2024-03-20 16:10:03 修改
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分类专栏： 数字逻辑（DE2-115） 文章标签： fpga开发
于 2024-03-20 15:13:13 首次发布
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本文链接：https://blog.csdn.net/weixin_47841246/article/details/136877575
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本文介绍了如何在DE2-115开发板上通过例化四个1位全加器构建4位全加器，使用SW输入作为加数，LEDR显示结果。通过UniversityProgramVWF工具进行了详细的仿真，并展示了波形图。
摘要由CSDN通过智能技术生成

Q：本期我们来实现4位全加器，并且用University Program VWF工具进行仿真。

A：顶层文件中例化4个1位全加器即实现一个4位全加器，这种加法器的进位信号由低位向高位逐级传递，因此也称为串行进位加法器；对应的4位全加器逻辑图：

image-20230906152649598

使用DE2-115开发板的SW[7:4]作为4位加数A，SW[3:0]作为4位加数B，SW[8]作为初始进位输入C[0]；LEDR[4:0]显示最终进位输出以及和的值。

image-20230906153156648

用University Program VWF工具进行仿真后的波形结果：

Terasic友晶科技
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使用Logisim软件设计8位串行加法器、8位可控加减法器、4位先行进位电路、4位快速加法器、16位快速加法器、32位快速加法器。
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Logisim是一款用于数字电路设计和模拟的软件，可以用来设计各种数字电路，包括加法器和进位电路。下面我将为您介绍如何使用Logisim设计这些电路。 1. 8位串行加法器： - 首先，创建一个新的Logisim项目。 - 在工具栏上选择“基本门”工具，然后拖动一个“半加器”和七个“全加器”到工作区。 - 将这些加法器按照串行连接的方式连接起来，确保每个加法器的进位输出连接到下一个加法器的进位输入。 - 将输入信号连接到第一个半加器的输入端，并将输出信号从最后一个全加器的输出端获取。 2. 8位可控加减法器： - 创建一个新的Logisim项目。 - 使用“选择”工具选择一个8位全加器。 - 在属性栏中设置全加器的输入为A、B和Cin，输出为Sum和Cout。 - 添加一个选择器（Multiplexer），设置选择器的输入为A、B和控制信号，输出为Sum。 - 将A和B作为选择器的输入，将控制信号连接到选择器的控制端，将选择器的输出连接到全加器的A输入。 - 将Cin连接到全加器的B输入，将全加器的Sum输出作为输出。 3. 4位先行进位电路： - 创建一个新的Logisim项目。 - 使用“选择”工具选择一个4位全加器。 - 将第一个全加器的Cin输入连接到一个常量1，将其Sum输出连接到第二个全加器的Cin输入，以此类推。 - 将输入信号连接到每个全加器的A和B输入，将最后一个全加器的Sum输出作为输出。 4. 4位快速加法器： - 创建一个新的Logisim项目。 - 使用“选择”工具选择一个4位全加器。 - 将输入信号连接到每个全加器的A和B输入，将每个全加器的Sum输出作为输出。 5. 16位快速加法器： - 创建一个新的Logisim项目。 - 使用“选择”工具选择一个16位全加器。 - 将输入信号连接到每个全加器的A和B输入，将每个全加器的Sum输出作为输出。 6. 32位快速加法器： - 创建一个新的Logisim项目。 - 使用“选择”工具选择一个32位全加器。 - 将输入信号连接到每个全加器的A和B输入，将每个全加器的Sum输出作为输出。 希望以上介绍对您有所帮助！如果您还有其他问题，请随时提问。
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