FPGA时序优化方法小结:
1.插寄存器,缩短组合逻辑的延时
2.寄存器复制
3.加两级寄存器,消除亚稳态,异步信号的同步处理
4.进行时序约束
5.进行logic lock 物理约束
6.采用multicycle 设计
7.FIFO
……
待完善
FPGA时序优化方法小结:
1.插寄存器,缩短组合逻辑的延时
2.寄存器复制
3.加两级寄存器,消除亚稳态,异步信号的同步处理
4.进行时序约束
5.进行logic lock 物理约束
6.采用multicycle 设计
7.FIFO
……
待完善