RS触发器（Quartus与Modelsim联合仿真）

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已于 2024-10-26 12:23:37 修改

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文章标签： fpga fpga开发

于 2024-10-25 21:28:35 首次发布

本文链接：https://blog.csdn.net/2201_75415349/article/details/143165979

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RS触发器可以由两个与非门构成，把两个与非门的输入端与输出端交叉连接，即可构成RS触发器。输入信号：置数端s，清零端r。输出信号：q和qn。

真值表如下：

RS触发器真值表
输入输出
R S Q QN
1 0 1 0
0 1 0 1
1 1 不变不变
0 0 不变不变

RS触发器真值表
输入	输出
R	S	Q	QN
1	0	1	0
0	1	0	1
1	1	不变	不变
0	0	不变	不变

一、RS触发器的电路符号

二、代码

module RS(q,qn,s,r);
input s,r;
output q,qn;

reg q,qn;
reg q1,qn1;

always @(*)
begin 
q1<=~(s&qn1);
qn1<=~(r&q1);
q=q1;
qn=qn1;
end
endmodule

三、仿真代码

`timescale 1ns/1ns

module RS_tb;
reg s;
reg r;

wire q;
wire qn;

RS u (
   .s(s),
   .r(r),
   .q(q),
   .qn(qn)
);

initial begin
    // 初始化输入
    s = 0;
    r = 0;
    #20; // 等待10ns

    // 测试RS触发器的各个输入组合
    s = 1; r = 0; // 置位
    #20;
    s = 0; r = 1; // 复位
    #20;
    s = 1; r = 1; // 非法状态，应该保持不变
    #20;
    s = 0; r = 0; // 保持
    #20;
    
    // 测试完成，结束仿真
    $finish;
end 
endmodule