VHDL设计出租车计价器

该博客介绍了如何使用VHDL在FPGA环境下设计一个出租车计价器。计价规则为:3公里内10元,之后每增加1公里收费1.6元,2分钟后每停1分钟加收1.5元。设计包括了多个组件,如信号整形、距离和时间测量、计费计算等,并展示了在不同FPGA软件平台如QuartusII、Vivado、ISE下的适用性。
摘要由CSDN通过智能技术生成

下面是本设计功能,功能可以增添修改。代码有详细注释。

 本工程创建于vivado下

下面是工程截图:

适用于quartusII、vivado、ISE等环境。

---文件名:           texi_all.vhd
---功  能:          出租车计价器
---说  明:          三公里以内10元,以后每增加一公里加1.6元,2分钟以后每停一分钟加1.5元。         
library IEEE;
use IEEE.STD_LOGIC_1164.ALL;
use IEEE.STD_LOGIC_ARITH.ALL;
use IEEE.STD_LOGIC_UNSIGNED.ALL;

entity texi_all is
    Port (clk : in std_logic;
        start : in std_logic;  --使能信号;
         dina  : in std_logic;    --停车信号;
        dinb  : in std_logic;  --公里脉冲信号;
        

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