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什么是时钟树综合
简单概括下,时钟树综合就是指从某个clock的root点长到各个sink点的clock buffer/inverter tree。工具试图将某个clock所属的所有sinks做到相同长度。从概念上,我们可以得到几个要点。
clock的root点需要定义清楚。这个可以通过create_clock来定义。如果是create_generated_clock,它的master clock也是很清晰的,即知道generate clock的source latency;
clock 的sinks要知晓。
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时钟树综合的目标
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clock skew尽量小,特别是对时钟质量要求比较高或者高频时钟;
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clock latency尽量短。
那么,为了达到以上两大目标,数字后端工程师任到重远。首先,我们拿到一个design,需要先花点时间,理清楚clock 结构,各种mode如何切换。同时,需要不断向前端设计人员请教design相关(后端需要知道的信息),比如哪些clock是需要同步,哪些是异步。