AXI STREAM

最新推荐文章于 2023-12-18 15:22:25 发布
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分类专栏： vivado FPGA 文章标签： fpga开发
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AXI STREAM 中的tvalid不能根据tready信号进行赋值，意思是说，当tready为高电平时，tvalid置为高电平，这是不允许的，因为会导致丢数。具体分析如下图：
在这里插入图片描述
如上图所示，因为代码中是时序逻辑，tvalid会在tready的后一拍，如果根据tready是否为高电平进行tvalid的赋值，那么tvalid与tready不能同步，此时会造成丢数。

薛定谔的bug~
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