IP核的使用

最新推荐文章于 2024-06-02 21:44:23 发布
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分类专栏： 工作 文章标签： FPGA 
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本文链接：https://blog.csdn.net/hi_qingtian/article/details/81290563
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本文介绍了FPGA设计中常用的IP核，包括PLL的工作原理及其接口定义，FIFO的概念、端口定义及重要参数，RAM的端口描述，以及乘法器的使用，通过实例展示了IP核在FPGA设计中的应用。
摘要由CSDN通过智能技术生成

（1）PLL的使用

PLL工作原理：压控振荡器通过自振输出一个时钟，同时反馈给输入端的相位频率检测器PFD，PFD根据比较输入时钟和反馈时钟的相位来判断VCO输出的快慢，同时输出pump-up与pump-down信号给环路低通滤波器LPF,LPF把这些信号转换为电压信号，再用来控制VCO的输出频率，当PFD检测到输入时钟和反馈时钟沿对齐时，锁相环就锁定了。

Pll锁相环的接口定义：inclk0:pll输入时钟

                                     arset:pll复位信号，高电平有效

                                     co:pll输出时钟

                                     locked：指示pll处理后的时钟已经稳定输出，高电平有效

（2）FIFO的使用

FIFO的理解：FIFO是一种先进先出的数据缓存器，它与普通存储器的区别是没有外部读写地址线，所以使用起来很简单，但缺点是只能顺序写入数据，顺序读出数据，其数据地址由内部读写指针自动加一完成，不像普通存储器

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晴天_你好
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