xilinx bank中DBC和QBC的理解

最新推荐文章于 2024-07-22 13:10:31 发布
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自己的理解记录的，有问题请指正，谢谢！！

在ultrascale中每个bank分成4个byte lanes T0、T1、T2、T3。每个byte lanes被分为上下两个nibble。T1和T2中包含QBC，也可能支持QBC和GC；T0和T3中上下nibble中都包含DBC；

QBC：可用于bank内所有byte lanes；

DBC：仅可用于byte lane内部；

GC：全局时钟，可以用于PLL和MMCM

dgr_2222
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