笔试题-2023-思特威-数字电路设计（CIS）【纯净题目版】

已于 2023-02-08 22:43:59 修改
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分类专栏： 2023 数字IC设计秋招复盘——数十家公司笔试题、面试实录 文章标签： 面经 刷题 秋招 数字IC设计
于 2023-02-08 22:42:48 首次发布
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这篇博客包含了2023年思特威数字电路设计笔试的题目，包括数字IC设计流程、D-Latch与D-Flipflop的区别、二进制补码运算、DFF时序分析和Verilog实现数据转换的问题。难度适中，适合数字IC设计的学习和复习。
摘要由CSDN通过智能技术生成

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题目背景

  • 笔试时间：2022.08.18
  • 笔试时长：90min
  • 应聘岗位：数字电路设计工程师（CIS）
  • 笔试平台：showmebug

题目评价

  • 难易程度：★★☆☆☆
  • 知识覆盖：★☆☆☆☆
  • 超纲范围：☆☆☆☆☆
  • 值得一刷：★☆☆☆☆

文章目录

1 数字IC设计的流程包含哪些？
2 简述下D-Latch与D- Flipflop的区别
3 用二进制补码运算推导出80-120的结果 (1bit符号位，7bit数据位)
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