verilog模拟仿真按键消抖

最新推荐文章于 2024-04-09 22:10:15 发布
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分类专栏： verilog 仿真 虚拟按键抖动 文章标签： verilog 仿真 按键消抖
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本文链接：https://blog.csdn.net/qq_15026001/article/details/89978831
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用verilog实现按键消抖，工具采用quartus II13 仿真软件采用ModelSim-Alter其中主要分为

 

             

其中vr_key_module主要产生虚拟的按键抖动功能。

顶层模块

module vr_debounce(
                            input Sys_clk,
                            input Sys_reset,
                            input Pin_in,
                            output Pin_out
                        );
                        
wire Q_Sig;                    
    vir_key_module U1 (
                            .sclk(Sys_clk),
                            .rst_n(Sys_reset),
                            .In_Sig(Pin_in),
                            .Q_Sig(Q_Sig)
                        );
                        
 debouce    U2(    
                 
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Mr.zhang_FPGA
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基于FPGA的按键消抖实验Verilog逻辑源码Quartus工程文件+文档说明，程序实现按键按下后数字加 1，并在数码管上显示出来，FPGA型号Cyclone4E系列中的EP4CE6F17C8，Quartus版本17.1。 module key_debounce( input clk, input rst_n, input key1, output [5:0] seg_sel, output [7:0] seg_data ); wire button_negedge; //Key falling edge ax_debounce ax_debounce_m0 ( .clk (clk), .rst (~rst_n), .button_in (key1), .button_posedge (), .button_negedge (button_negedge), .button_out () ); wire[3:0] count; wire t0; count_m10 count10_m0( .clk (clk), .rst_n (rst_n), .en (button_negedge), .clr (1'b0), .data (count), .t (t0) ); wire[3:0] count1; wire t1; count_m10 count10_m1( .clk (clk), .rst_n (rst_n), .en (t0), .clr (1'b0), .data (count1), .t (t1) ); //Count decoding wire[6:0] seg_data_0; seg_decoder seg_decoder_m0( .bin_data (count), .seg_data (seg_data_0) ); wire[6:0] seg_data_1; seg_decoder seg_decoder_m1( .bin_data (count1), .seg_data (seg_data_1) ); seg_scan seg_scan_m0( .clk (clk), .rst_n (rst_n), .seg_sel (seg_sel), .seg_data (seg_data), .seg_data_0 ({1'b1,7'b1111_111}), .seg_data_1 ({1'b1,7'b1111_111}), .seg_data_2 ({1'b1,7'b1111_111}), .seg_data_3 ({1'b1,7'b1111_111}), .seg_data_4 ({1'b1,seg_data_1}), .seg_data_5 ({1'b1,seg_data_0}) ); endmodule
按键消抖——task任务和仿真平台搭建
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Xilinx FPGA工程例子源码 ...实现基于spartan3与CAN总线连接后的的汽车时速的模拟仿真.zip 扩频接收机设计实例.zip 摄像头的硬件函数(IP核).zip 用FPGA实现数字锁相环.zip 用FPGA模拟VGA时序,PS_2总线的键盘接口VHDL源
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通过按键消抖扩展讲解FOR循环的使用
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verilog按键消抖仿真
07-28
你可以使用 Verilog 语言来进行按键消抖的仿真。按键消抖是为了解决按键在按下或释放时可能引起的抖动或干扰问题。以下是一个简单的 Verilog 代码示例： ```verilog module debounce( input wire btn, // 按键输入 output reg debounced_btn // 消抖后的按键输出 ); parameter debounce_cycles = 10; // 消抖周期数 reg [debounce_cycles-1:0] history; // 历史按键状态记录 always @(posedge btn) begin history <= {history[debounce_cycles-2:0], btn}; // 更新历史记录 debounced_btn <= (history == debounce_cycles'b1); // 判断是否稳定按下 end endmodule ``` 在这个示例中，debounce 模块接收一个按键输入信号 `btn`，并输出一个消抖后的信号 `debounced_btn`。`debounce_cycles` 参数定义了消抖周期数，即需要连续多少个周期保持稳定状态才认为按键被按下。 在 `always @(posedge btn)` 块中，我们使用一个 `history` 寄存器来记录最近的按键状态。每次按键信号 `btn` 上升沿触发时，我们将历史记录左移一位，并将当前的按键状态添加到最低位。然后，通过比较 `history` 是否全为1，来判断按键是否稳定按下。如果是，则将 `debounced_btn` 设置为1；否则，保持为0。 你可以使用任何 Verilog 仿真工具（如 ModelSim、Xilinx ISE、Quartus Prime 等）来仿真这个代码，并观察消抖效果。你可以创建一个测试平台，通过模拟按键输入信号，来验证按键消抖的功能。 希望对你有所帮助！如果有任何问题，请随时问我。

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