Vivado中的IP核——Interrupt Controller详解

资料ID:PG099
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Vivado的中断控制器处理中断时有两种模式,分别为快速中断模式和正常中断模式。本文只介绍正常中断模式。由于赛灵思提供的关于中断控制器的驱动程序个人感觉有点复杂,所以本文最后提供了一个精简版的驱动程序。由于个人也是刚刚接触基于软核处理器及其外设的嵌入式开发,所以可能有理解错误的地方,欢迎大家指正。
驱动程序通过配置与当前设备相关的寄存器来使其按照预期运行,所以接下来介绍一些与正常中断模式相关的寄存器。
中断控制器框图如下。
在这里插入图片描述

Register Space

与中断控制器相关的所有寄存器如下表。
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表中的Address Offset表示地址偏移,这里的偏移是针对中断控制器的基地址的,即Base Address。基地址可以从两个地方获得,一是在Vivado中的Block Design窗口中的Address Editor界面,如下图。二是在Vitis中,基于该硬件平台生成的xparameters.h头文件中,如下图。在本例中,该基地址为0x41200000。
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以上的寄存器中,与正常中断模式直接相关的为ISR、IER、IAR、IVR、MER。

ISR

ISR寄存器为中断状态寄存器,该寄存器的值表征有效的中断信号存在与否。某位为0,表示该位对应的中断信号无效;某位为1,表示该位对应的中断信号有效。该寄存器中有效位的数目为软件中断数目和外设中断数目之和。当MER寄存器中的HIE位为0时,外设对应的中断位也可以通过使用软件向ISR中相应位写入1来产生;当MER寄存器中的HIE位为1时,外设对应的中断位不可由软件写入。
ISR具体的位定义如下图。
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IER

IER寄存器是中断使能寄存器,是一个可读可写寄存器,该寄存器与ISR寄存器是相互独立的。当ISR中某位为1时,说明该位对应的外设产生了有效中断,或者利用软件改写了ISR中的该位值。但是若该位在IER寄存器中对应位为0,则不会产生一个中断输出Irq,这个输出是传递给处理器的。
IER具体的位定义如下。
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IAR

IAR寄存器是中断确认寄存器,该寄存器是用于清除ISR寄存器的。当某个中断对应的中断处理程序调用完成后,需要清除ISR寄存器中的对应位,不然会一直进入该中断处理程序。向IAR寄存中的相应位写入1,就可以清除ISR中的对应位。注意,在正常中断模式中,这个需要手动清除,即通过软件清除。
IAR具体的位定义如下。
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IVR

IVR寄存器被叫做中断向量寄存器,该寄存器存储着最高优先级、有效的、使能的中断对应的序号。
定义如下。
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MER

MER寄存器是主使能寄存器,该寄存器中有效位只有前两位。第一位是ME,即master IRQ enable,如果该位为0,则中断控制器不能向处理器产生中断。第二位是HIE,即Hardware Interrupt Enable,如果该位为0,则ISR中外设对应的中断位就不能通过使用外设产生中断来使该位为1,只能通过软件;若该位为1,则与0效果相反。
MER位定义如下。
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示例程序:利用软件产生中断,并调用相应中断处理程序

为了测试比较方便,本文使用软件来产生中断。


/***********************header file included*********************/
#include "xil_printf.h"
/****************************************************************/

/***********************constant definition**********************/
#define BASEADDR 0x41200000
#define ISR      0x00
#define IER      0x08
#define IAR      0x0C
#define IVR      0x18
#define MER      0x1C
/****************************************************************/

/**********************other definition**************************/
#define GETX(x) (*(volatile int *)(BASEADDR + x))
/****************************************************************/

/***********************function prototype**********************/
void interrupt_handler_function() __attribute__((interrupt_handler));
void interrupt0();
void interrupt1();
extern void microblaze_enable_interrupts();
/***************************************************************/

int main()
{
	/***************initialize interrupt controller******************/
	GETX(IER) |= 0x3;
	GETX(MER) |= 0x1;
	/****************************************************************/
	microblaze_enable_interrupts();

	GETX(ISR) = 0x2;
	print("successfully first!!!\r\n");
	GETX(ISR) = 0x1;
	print("successfully second!!!\r\n");
}

void interrupt_handler_function()
{
	if(GETX(IVR) == 0x0)
		interrupt0();
	else if(GETX(IVR) == 0x1)
		interrupt1();
	else
		return;
}
void interrupt0()
{
	print("interrupt0 handler is called!!!\r\n");
	GETX(IAR) |= 0x1;
}
void interrupt1()
{
	print("interrupt1 handler is called!!!\r\n");
	GETX(IAR) |= 0x2;
}

实验结果如下图。
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### 回答1: Vivado FFT IP核是Xilinx公司提供的一种用于高性能快速傅里叶变换(FFT)的可编程逻辑器件,可用于信号处理、通信系统、雷达、音频处理和图像处理等领域。 Vivado FFT IP核的主要功能是实现快速傅里叶变换,这是一种将时域信号转换为频域信号的数学技术。FFT是一种高效的算法,能够在较短的时间内对信号进行频谱分析和频率测量。Vivado FFT IP核提供了多种FFT算法,包括基于蝶形算法、流水线和并行化等技术,可以根据应用的需求选择适合的算法。 Vivado FFT IP核提供了多种配置选项,可以实现不同数据宽度、数据精度和时域点数的FFT计算。用户可以通过Vivado设计环境来配置和生成FFT IP核,方便地集成到自己的设计IP核的接口支持AXI4-Stream和AXI4-Lite等标准接口,与其他系统组件进行数据交换。 通过使用Vivado FFT IP核,用户可以在FPGA上快速实现高性能的FFT计算,提高系统的性能和效率。IP核的可编程性使得用户可以根据应用需求进行定制,并且可以随着设计的迭代进行功能增强或优化。此外,使用IP核还可以减少设计开发时间和复杂度,提高设计的可重用性。 综上所述,Vivado FFT IP核是一种用于快速傅里叶变换的可编程逻辑器件,具有灵活的配置选项和高性能的计算能力。使用该IP核可以快速实现高性能的FFT计算,提高系统的性能和效率。 ### 回答2: Vivado FFT IP核是Xilinx公司提供的一种用于快速傅里叶变换(FFT)运算的IP核。FFT是一种用于信号频谱分析的算法,广泛应用于数字信号处理领域。Vivado FFT IP核通过硬件加速的方式,实现了高效的FFT计算。 Vivado FFT IP核具有以下主要特点: 1. 高性能:Vivado FFT IP核使用专门的FFT硬件来执行计算,速度比软件实现的FFT更快。它能够在很短的时间内完成大规模FFT计算。 2. 可定制性:Vivado FFT IP核提供了许多可定制的选项。用户可以根据具体的需求选择不同的FFT大小、输出数据宽度、输入数据格式等。这样有助于优化设计,提高系统整体性能。 3. 多种接口:Vivado FFT IP核支持多种接口,如AXI4-Stream接口、AXI4-Lite接口等,方便与其他IP核或外部系统进行连接。 4. 低功耗:Vivado FFT IP核经过优化设计,能够在低功耗下运行,节约能源消耗。 Vivado FFT IP核的应用范围广泛。在通信领域,它可以用于信号解调、频谱分析、通道估计等。在图像处理领域,它可以用于图像压缩、图像增强等。此外,在雷达、声音处理、金融分析等其他领域也有广泛的应用。 Vivado FFT IP核的使用步骤相对简单。首先,在Vivado设计工具导入该IP核,在设计进行配置和参数设置。然后,将IP核与其他系统进行连接,并根据需要编写相应的控制和数据处理逻辑。最后,生成比特流文件(bitstream)并下载到目标设备进行验证和调试。 总之,Vivado FFT IP核是一种高性能、可定制的FFT计算IP核,广泛应用于信号处理等领域,为设计人员提供了快速可靠的FFT计算解决方案。
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