工艺库相关含义解释

LVT, RVT, HVT

LVT, RVT, HVT这几个都是CMOS集成电路的Vth阈值电压相关的基本概念。通常将传输特性曲线中输出电压随输入电压改变而急剧变化转折区的中点对应的输入电压称为阈值电压。
HVT = High V threshold. Can be used in the path where timing is not critical. So by using HVT cells we can save power.
LVT - Low V threshold. One should use these cells in timing critical paths. These cells are fast but , comsumes more power due to its leakage. So it will consume more power. So use only when timing is critical.
SVT- Standard V threshold. Best of both world. Medium delay and medium power requirment. So if timing is not met by small magin with HVT, you should try with SVT. And at last LVT.
RVT- Regular V threshold. Another name for SVT.阈值电压越低,因为饱和电流变小,所以速度性能越高;但是因为漏电流会变大,因此功耗会变差。
速度大小按快到慢依次排列为SLVT, LVT, RVT, HVT。 功耗大小却正好相反。即HVT的cell其阈值电压最大其掺杂浓度越高,其泄露功耗最小;根据时序紧张还是不紧张,对于关键路径选择速度快,功耗差的,对于时序比较宽松的,可以用速度慢一些的器件。在满足时序的情况下降低功耗~
见这个帖子:https://bbs.eetop.cn/thread-446939-1-1.html

IC库命名规则和选库方案scc55nll_hd_pmk_hvt_ss_v1p08_125c_basic

详见这个帖子:https://bbs.eetop.cn/thread-589285-1-1.html

  • 125c:125摄氏度

hd

hd:high density高稳定, — 该参数还可能是hs(high speed高速),vhs(very high speed超高速)
HD和HVT这两个参数是根据设计属性来选的,如果设计的时序比较紧张。则要选择高速库,比如HS和LVT,注意LVT是低阈值电压,阈值低,开启的速度快,但是漏电流大,功耗高

pmk

pmk,power managment kit 低功耗部分,low power设计中使用

ss、ff、tt

是指的综合和时序分析中最主要的3个corner,分别对应的worst corner、best corner、 typical corner
一般分析建立时间用worst,保持时间用best corner。可以保证cover边界情况。保证时序收敛。
在综合时候,分析setup一般都选ss corner的库,在pt做sta时,可以使用ff corner来分析hold

v1p08

是电压1.08V(1.2V下浮10%)

neg

带负沿的时序检查

pg

带电源pad的cell

在电子设计自动化(EDA)领域,Verilog HDL 是一种重要的硬件描述语言,广泛应用于数字系统的设计,尤其是在嵌入式系统、FPGA 设计以及数字电路教学中。本文将探讨如何利用 Verilog HDL 实现一个 16×16 点阵字符显示功能。16×16 点阵显示器由 16 行和 16 列的像素组成,共需 256 个二进制位来控制每个像素的亮灭,常用于简单字符或图形显示。 要实现这一功能,首先需要掌握基本的逻辑门(如与门、或门、非门、与非门、或非门等)和组合逻辑电路,以及寄存器和计数器等时序逻辑电路。设计的核心是构建一个模块,该模块接收字符输入(如 ASCII 码),将其转换为 16×16 的二进制位流,进而驱动点阵的 LED 灯。具体而言,该模块包含以下部分:一是输入接口,通常为 8 位的 ASCII 码输入,用于指定要显示的字符;二是内部存储,用于存储字符对应的 16×16 点阵数据,可采用寄存器或分布式 RAM 实现;三是行列驱动逻辑,将点阵数据转换为驱动 LED 矩阵的信号,包含 16 个行输出线和 16 个列使能信号,按特定顺序选通点亮对应 LED;四是时序控制,通过计数器逐行扫描,按顺序控制每行点亮;五是复用逻辑(可选),若点阵支持多颜色或亮度等级,则需额外逻辑控制像素状态。 设计过程中,需用 Verilog 代码描述上述逻辑,并借助仿真工具验证功能,确保能正确将输入字符转换为点阵显示。之后将设计综合到目标 FPGA 架构,通过配置 FPGA 实现硬件功能。实际项目中,“led_lattice”文件可能包含 Verilog 源代码、测试平台文件、配置文件及仿真结果。其中,测试平台用于模拟输入、检查输出,验证设计正确性。掌握 Verilog HDL 实现 16×16 点阵字符显示,涉及硬件描述语言基础、数字逻辑设计、字符编码和 FPGA 编程等多方面知识,是学习
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