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原创 Verilog HDL:对Verilog中有符号数和无符号数的认识

本文总结了Verilog中有符号数和无符号数的表现形式,介绍了原码、反码和补码以及相互的转换关系。

2023-08-14 15:17:36 1827

原创 Vitis2021.1报错:fatal error: xparameters.h: No such file or directory

Vitis2021.1报错:fatal error: xparameters.h: No such file or directory

2023-08-01 15:42:53 3452 4

原创 HDLBits从零开始——第171题到178题答案

本文记录了个人在HDLBits上第171到178题的刷题结果,大家可以互相交流和指正。

2023-04-08 20:18:22 154

原创 HDLBits从零开始——第161题到170题答案

本文记录了个人在HDLBits上第161到170题的刷题结果,大家可以互相交流和指正。

2023-04-08 20:14:30 82

原创 HDLBits从零开始——第151题到160题答案

本文记录了个人在HDLBits上第151到160题的刷题结果,大家可以互相交流和指正。

2023-04-08 20:06:13 108

原创 HDLBits从零开始——第141题到150题答案

本文记录了个人在HDLBits上第141到150题的刷题结果,大家可以互相交流和指正。

2023-04-08 20:00:39 91

原创 HDLBits从零开始——第131题到140题答案

本文记录了个人在HDLBits上第131到140题的刷题结果,大家可以互相交流和指正。

2023-04-08 19:56:01 106

原创 HDLBits从零开始——第121题到130题答案

本文记录了个人在HDLBits上第121到130题的刷题结果,大家可以互相交流和指正。

2023-04-08 19:48:06 76

原创 HDLBits从零开始——第111题到120题答案

本文记录了个人在HDLBits上第111到120题的刷题结果,大家可以互相交流和指正。

2023-04-08 19:36:36 84

原创 HDLBits从零开始——第101题到110题答案

本文记录了个人在HDLBits上第101到110题的刷题结果,大家可以互相交流和指正。

2023-03-26 22:56:12 116

原创 HDLBits从零开始——第91题到第100题答案

本文记录了个人在HDLBits上第91到100题的刷题结果,大家可以互相交流和指正。

2023-03-25 16:03:15 88

原创 HDLBits从零开始——第81题到第90题答案

本文记录了个人在HDLBits上第81到90题的刷题结果,大家可以互相交流和指正。

2023-03-24 15:31:32 257

原创 HDLBits从零开始——第71题到80题答案

本文记录了个人在HDLBits上第71到80题的刷题结果,大家可以互相交流和指正。

2023-03-23 22:29:26 140

原创 HDLBits从零开始——第61题到第70题答案

本文记录了个人在HDLBits上第61到70题的刷题结果,大家可以互相交流和指正。

2023-03-22 22:05:55 139

原创 HDLBits从零开始——第51题到第60题答案

本文记录了个人在HDLBits上第51到60题的刷题结果,大家可以互相交流和指正。

2023-03-21 21:52:25 124

原创 HDLBits从零开始——第41题到第50题答案

本文记录了个人在HDLBits上第41到50题的刷题结果,大家可以互相交流和指正。

2023-03-20 23:13:50 103

原创 HDLBits从零开始——第31题到第40题答案

本文记录了个人在HDLBits上第31到40题的刷题结果,大家可以互相交流和指正。

2023-03-19 22:10:28 127

原创 HDLBits从零开始——第21题到第30题答案

本文记录了个人在HDLBits上第21到30题的刷题结果,大家可以互相交流和指正。

2023-03-19 16:16:40 225

原创 HDLBits从零开始——第11题到第20题答案

本文记录了个人在HDLBits上第11到20题的刷题结果,大家可以互相交流和指正。

2023-03-18 19:46:24 182

原创 HDLBits从零开始——第1题到第10题答案

本文记录了个人在HDLBits上第1到10题的刷题结果,大家可以互相交流和指正。

2023-03-18 15:35:58 325

原创 Verilog HDL:使用移位操作符实现无符号数乘法(位宽可修改)

本文通过移位操作符来实现了无符号数的乘法,其中举例讲解了其原理,代码以8位*8位为例,读者可自行修改成自己需要的位宽。

2022-10-20 11:32:24 1208

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