Xilinx FPGA未使用管脚的默认电平设置方法

最新推荐文章于 2024-02-11 01:35:53 发布
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在vivado中，FPGA未使用管脚的默认电平设置方法

方法一：直接在约束文件中写入tcl命令

set_property BITSTREAM.CONFIG.UNUSEDPIN PULLUP [current_design]
可选参数有 PULLUP - PULLDOWN - PULLNONE

方法二：在软件中设置

1，在run implementation后，点击open implementation design

在这里插入图片描述

2，打开后右键点击Generate Bitstream，然后点击bitstream setting

在这里插入图片描述

3，然后点击Configure additional bitstream settings

在这里插入图片描述

4，然后点击configuration

在这里插入图片描述

5，往下拉动右边的滚动条到下图的位置，就可以看到设置的复选框，即可设置为你希望的输出电平状态

在这里插入图片描述

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