【ARM Coresight 系列文章19.1 -- Cortex-A720 PMU 详细介绍】

已于 2023-11-07 16:52:35 修改
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分类专栏： # ARM Coresight 系列 文章标签： arm开发 PMU
于 2023-10-20 20:21:59 首次发布
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本文链接：https://blog.csdn.net/sinat_32960911/article/details/133904586
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本文详细介绍了Cortex-A720的PMU（Performance Monitor Unit）特性，包括其硬件事件监控、周期计数器、PMU快照功能以及中断处理。PMU支持多种事件计数，如cpu-cycles、instructions等，并可通过中断产生采样点进行性能分析。Cortex-A720 PMU包含4到20个64位事件计数器，通过配置寄存器选择和启用事件，当计数达到预设值时产生中断。
摘要由CSDN通过智能技术生成


请阅读【ARM Coresight SoC-400/SoC-600 专栏导读】

文章目录

概述

PMU(Performance Monitor Unit)本来指的就是硬件上的性能监控计数器(counter)。
因为软件 trace 方法存在制约制约：

  • 软件大部分是插桩法，对于没有插桩的地方缺乏监控；
  • 软件使用 hrtimer 的采样法开销较大，而且不精确。所以使用硬件采样来trace是一个很好的补充。

Arm64 的 Hardware PMU 可以监控许多种事件：

  • cpu-cycles
  • instructions
  • cache-references
  • cache-misses
  • branch-misses
  • cache相关事件等等。

它的监控原理比较简单：每个CPU有几个 counter，Counter0 固定只能配置成 cpu-cycles，其他 counter 可以配置成支持的任意类型。当 counter 的计数达到我们配置的值后，产生中断，在中断中记录ELR/

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主公讲 ARM
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{r1,-r3,r5}, 这里代表的是，将寄存器组的数据，压栈到 sp 指针指向的地方，并且， sp 指针，需要同步向下走。,{r1-r3,r5} , 代表的是，出栈的操作， 出栈的顺序也是， 低地址的内存的值，对应的是低标号的寄存器。, {r1-r3,r5,lr} , 这是在压栈， 这里特别提到了，lr ,这是把函数返回的PC值， 也压栈了。注意： r1,r2,r3,r5 ,在往内存中压栈的时候， 顺序是这样的， 内存中的低地址，存放的是 低标号的寄存器的值。举例： 计算一个数组的所有元素的和。
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