接收、发送、滤波器 AD9361 介绍(上)
增益控制、时钟和PLL、ENSM AD9361 介绍 (中)
校准、数据接口 (CMOS) AD9361 介绍 (下)
数据接口(LVDS) SPI和附加接口信号在AD9361 介绍 (终)
VIVADO 和 SDK 为2016.4版
一 、JTAG调试
拨码开关如图所示
SW4 0 1
SW11 0 0 0 0 0
点击Program FPGA
如果SW4为 1 0 时会提示如下错误
配置 Run Configurations 如下
二、生成BOOT.mcs文件
1.在vivado中生成比特流文件
2.在SDK中通过JTAG在线调试 ,调试好后将程序烧写到FLASH中
a.设置现在的板级支持包,选中xilffs库,否则在使用现在的板级支持包创建FSBL文件时会提示需要xilffs库(!也可以在新建FSBL文件时直接创建新的板级支持包 VIVADO 和 SDK 为2018.3版直接创建比较合适,要不板级支持包少几个头文件)
b.进入设置界面
勾选xilffs库
c. 新建FSBL文件
(2018.3直接建新的FSBL_bsp板级支持包)
d.生成BOOT.mcs
FSBL.elf
bit文件
XXX.elf 一定按顺序添加
三、将BOOT.mcs文件固化到FLASH
在JTAG启动模式下点击Program Flash