FPGA验证学习(四):SoC的验证与测试

前言

验证和测试是两个不同的概念。

前面的三篇嘞,咱们对整个开发的流程有了个了解,这里就来看看验证与测试,芯片这个东西流片一次可太贵了,所以一次芯片的开发流程有超级多的时间都花在了验证上。

1-验证

一般验证是指检验电路的逻辑、功能、时序等是否满足设计者在设计前提出的要求,功能是否完善,时序是否满足

验证的内容一般是面向功能性的。验证是设计过程中的第一道关卡,如果验证没有通过就没有办法进行后面的工作。目前常做的验证一般采用仿真的技术进行,通过计算机建立仿真环境,给被测电路加激励,分析响应或者检查电路内部的所有信息。按设计的不同阶段可以分为行为级仿真、门级仿真、后仿真。(因为每个设计阶段都会设计到仿真与验证,这个其实和软件设计一样,问题发现的时间越晚越危险!!!)

2-测试

测试是设计过程中验证工作的继续,它实际上是对现实芯片的验证,为最终的半导体产品的质量和可靠性提供一种量度。

一个合格的半导体产品一般要进行两次测试。

  • 一次是晶圆片测试(Wafer Test),即制造好的晶圆片需要进行严格的测试,只有通过测试的裸片(Die)才会被划片、封装。
  • 另一次是产品测试(Production Test),即通过晶圆片测试和封装的芯片必须进一步进行测试以确认没有故障才能成为真正的半导体产品。

测试实际上是指将一定的激励信号加载到被测电路

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FPGA原型验证手册的第七章中,我们将探讨基于SoC的系统的复杂性及其在验证过程中所面临的挑战。我们还将比较和对比基于FPGA的原型与其他原型方法,包括系统级虚拟建模。在这一章之后,我们将准备深入研究基于FPGA的原型技术如何有利于一些实际项目,并为基于FPGA的原型技术提供一些指导。 在这一章中,我们还将重点讨论针对FPGA的设计适应。这包括修改SoC RTL的设计,以更好地适应FPGA技术和特定的原型平台。典型的修改可能涉及删除没有原型的块,用时钟生成和其他IP等FPGA结构替换一些SoC特定的结构,以及调整内存等块的大小以更好地适应FPGA。 此外,我们还将介绍FPGA综合工具在原型设计中的作用。由于FPGA综合工具对FPGA架构有深入的了解,因此作为原型,我们可以依赖大多数SoC RTL被自动有效地映射,而不必手动修改RTL并用FPGA等价的代码替换它。这一章还将介绍综合和原型设计的三个重要定律,帮助读者更好地理解原型验证过程。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* [FPGA原型验证手册:第一章-引言:系统验证的挑战(一)](https://blog.csdn.net/weixin_45264425/article/details/129870169)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] - *2* *3* [FPGA原型验证手册:第三章-今天的FPGA技术:芯片和工具(二)](https://blog.csdn.net/weixin_45264425/article/details/129942582)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_1"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]

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