FPGA开发工具
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本专栏介绍FPGA相关的开发工具应用。
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【Lattice FPGA 开发】Diamond的使用
Diamond的使用。原创 2024-04-15 20:15:08 · 503 阅读 · 0 评论 -
【Lattice FPGA 开发】Modelsim与Diamond联合仿真
本文讲解Modelsim与Diamond进行联合仿真步骤,以及对遇到问题的解决与说明。原创 2024-04-15 19:58:57 · 1164 阅读 · 0 评论 -
【Lattice FPGA 开发】IP核的调用
本文介绍Diamond开发软件进行IP核调用与对应官方文档查找方法。原创 2024-03-05 21:44:56 · 982 阅读 · 0 评论 -
【Modelsim】数据显示设置
本文介绍modelsim使用中数据的显示设置,定点小数的显示、模拟波形的显示、数据截位查看、信号颜色和行高设置的操作。原创 2024-01-25 21:24:19 · 1673 阅读 · 0 评论 -
Vivado与Notepad++关联步骤
本文内容为Vivado与Notepad++的关联步骤。原创 2023-09-27 09:32:17 · 2267 阅读 · 0 评论 -
Vivado中增加源文件界面中各选项的解释
本文对Vivado中增加源文件界面Add or Create Design Sources和Add or Create Smulaton sources中的选项Scan and add RTL include files into project、Copy sources into project和Add sources from subdirectories作出解释。原创 2023-09-21 10:24:07 · 1433 阅读 · 1 评论 -
vivado乘法器IP核进行无符号与有符号数相乘问题的验证
本文验证乘法器IP核Multiplier进行无符号(unsigned)与有符号数(signed)相乘的正确性,其中也遇到了一些问题,做此记录。原创 2023-09-18 18:59:57 · 1156 阅读 · 0 评论 -
Vivado IP中Generate Output Products界面的设置说明
在创建IP核时,将IP核的信息配置完成之后会弹出Generate Output Products界面,介绍其中的Synthesis Options和Run Settings部分设置说明。原创 2023-09-13 20:54:35 · 2145 阅读 · 0 评论 -
【在线仿真】使用HDLBits进行FPGA代码在线综合仿真以及时序图生成
本文讲述使用Hdlbits进行FPGA代码在线综合仿真以及时序图生成,用于验证自己的设计。原创 2023-09-09 15:18:52 · 996 阅读 · 0 评论 -
Vivado工程创建、仿真、下载与固化全流程
本文以一个简单工程为例,介绍使用Vivado新建工程、代码的编写、Testbench代码的编写、波形仿真分析、引脚约束、生成bit流文件、通过JTAG将网表下载到开发板、程序的固化与下载全流程。原创 2023-08-16 20:56:21 · 1866 阅读 · 1 评论 -
ISE中逻辑分析仪ChipScope的使用
本文介绍ISE中逻辑分析仪ChipScope的使用。原创 2023-07-09 18:28:40 · 2112 阅读 · 0 评论