Vivado关联Modelsim进行仿真

岁岁人如旧

已于 2023-05-06 19:48:14 修改

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分类专栏： FPGA 文章标签： fpga开发

于 2023-05-06 19:43:31 首次发布

原文链接：https://blog.csdn.net/weixin_42837669/article/details/107829499

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前言

Vivado自带的仿真工具Vivado Simulator使用体验不佳，使用当前最流行的Verilog仿真工具Modelsim更加高效便捷。Vivado支持多种第三方仿真工具，包括Modelsim，Questasim等，本文将介绍如何在Vivado中使用Modelsim进行仿真。

不同版本的Vivado需要搭配对应版本的modelsim，否则在运行仿真时会报错：

WARNING: [Vivado 12-5495] Detected incompatible modelsim simulator installation version ‘2019.4’! The supported simulator version for the current Vivado release is ‘10.6c’.

之前我在Vivado 2018.3中使用Modelsim 2019.4，就会报版本不兼容的错误，提示支持的Modelsim版本是10.6c。实测Vivado 2018.3 + Modelsim 10.6e也完全OK。

具体Vivado版本对应的Modelsim版本可参考xilinx官网：

Vivado Simulation-主要的Vivado Design Suite版本支持的第三方模拟器

Vivado与Modelsim软件下载可参考我的专栏：软件安装

Vivado 2020.2+ Modelsim SE 2020.4 联合仿真，具体步骤如下：

一. 编译Vivado仿真库

打开Vivado，Tools -> Compile Simulation Libraries

勾选Compile Xilinx IP，此选项表示此次将会编译Vivado中所有的Xilinx IP，以后使用IP时不需要再次编译

注意：

1.这里的指定GCC可执行文件路径是Vivado 2020.2版本新加入的，Vivado 2018.3中没有这部分。此GCC路径不能不填，否则会有如下提示：

2.指定GCC路径是用作编译SystmC IP用的，如果没用到SystemC IP，可随意指定一个路径，例如桌面C:\Users\xu\Desktop，也可以进行编译。

3.推荐的做法是指定GCC路径为D:\Xilinx\Vivado\2020.2\tps\win64\msys64\mingw64\bin，这是Vivado自带的GCC.exe文件，指定此路径没什么问题。

4.Command中会有TCL命令，复制此命令到Tcl Console窗口中运行和设置完点击Compile效果相同。

点击Complie，等待编译完成。在左下角的Tcl Console窗口可以看到编译过程，编译时间和编译结果。编译耗时取决于电脑处理器性能，我的AMD Ryzen 7 3800X用了27分钟才编译完。编译完成后TCL窗口会显示下图所示表格，注意检查是否有Error，有个别error也不要紧，出错的IP可能根本用不上。